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參數(shù)資料
| 型號： | AD9571ACPZLVD-RL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 17/20頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PLL CLOCK GEN 25MHZ 40LFCSP |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 類型： | 時鐘發(fā)生器，扇出配送，多路復(fù)用器 |
| PLL： | 是 |
| 輸入： | 晶體 |
| 輸出： | CMOS，LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:10 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 156.25MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.97 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 40-WFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 40-LFCSP-WQ（6x6） |
| 包裝： | 帶卷 (TR) |
AD9571
Rev. 0 | Page 6 of 20
CLOCK OUTPUTS
Typical (typ) is given for VS = 3.3 V ± 10%, TA = 25°C, unless otherwise noted. Minimum (min) and maximum (max) values are given
over full VS and TA (40°C to +85°C) variation.
Table 6.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
LVPECL CLOCK OUTPUTS
Output Frequency
156.25
MHz
Output High Voltage (V
OH)
V
S 1.24
V
S 1.05
V
S 0.83
V
Output Low Voltage (V
OL)
V
S 2.07
V
S 1.87
V
S 1.62
V
Output Differential Voltage (V
OD)
700
825
950
mV
Duty Cycle
45
55
%
LVDS CLOCK OUTPUTS
Output Frequency
156.25
MHz
Differential Output Voltage (V
OD)
250
350
475
mV
Delta V
OD
25
mV
Output Offset Voltage (V
OS)
1.125
1.25
1.375
V
Delta V
OS
25
mV
Short-Circuit Current (I
SA, ISB)
14
24
mA
Output shorted to GND
Duty Cycle
45
55
%
CMOS CLOCK OUTPUTS
Output Frequency
33.33
MHz
Output High Voltage (V
OH)
V
S 0.1
V
Sourcing 1.0 mA current
Output Low Voltage (V
OL)
0.1
V
Sinking 1.0 mA current
Duty Cycle
42
58
%
TIMING CHARACTERISTICS
Typical (typ) is given for VS = 3.3 V ± 10%, TA = 25°C, unless otherwise noted. Minimum (min) and maximum (max) values are given
over full VS and TA (40°C to +85°C) variation.
Table 7.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
LVPECL
Termination = 200 to 0 V; C
LOAD = 0 pF
Output Rise Time, t
RP
480
625
810
ps
20% to 80%, measured differentially
Output Fall Time, t
FP
480
625
810
ps
80% to 20%, measured differentially
LVDS
Termination = 100 differential; C
LOAD = 0 pF
Output Rise Time, t
RL
160
350
540
ps
20% to 80%, measured differentially
Output Fall Time, t
FL
160
350
540
ps
80% to 20%, measured differentially
CMOS
Termination = 50 to 0 V; C
LOAD = 5 pF
Output Rise Time, t
RC
0.25
0.50
2.5
ns
20% to 80%
Output Fall Time, t
FC
0.25
0.70
2.5
ns
80% to 20%
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