參數(shù)資料
型號(hào)： AD9781BCPZRL
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 17/32頁(yè)
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描述： IC DAC 14BT 600MSPS LVDS 72LFCSP
產(chǎn)品培訓(xùn)模塊： Data Converter Fundamentals
DAC Architectures
標(biāo)準(zhǔn)包裝： 2,000
位數(shù)： 14
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 2
電壓電源： 模擬和數(shù)字
功率耗散（最大）： 315mW
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 72-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 72-LFCSP
包裝： 帶卷 (TR)
輸出數(shù)目和類型： 4 電流，單極；4 電流，雙極
采樣率（每秒）： 600M
AD9780/AD9781/AD9783
Data Sheet
Rev. B | Page 24 of 32
SPI PORT, RESET, AND PIN MODE
In general, when the AD9780/AD9781/AD9783 are powered
up, an active high pulse applied to the RESET pin should follow.
This ensures the default state of all control register bits. In
addition, once the RESET pin goes low, the SPI port can be
activated; thus, CSB should be held high.
For applications without a controller, the AD9780/AD9781/
AD9783 also supports pin mode operation, which allows some
functional options to be pin selected without the use of the SPI
port. Pin mode is enabled anytime the RESET pin is held high.
In pin mode, the four SPI port pins take on secondary
functions, as shown in Table 13.
Table 13. SPI Pin Functions (Pin Mode)
Pin
Name
Pin Mode Function
SDIO
DATA (Register 0x02, Bit 7), bit value (1/0) equals pin
state (high/low).
CSB
Enable mix mode. If CSB is high, Register 0x0A is set
to 0x05, putting both DAC1 and DAC2 into mix mode.
SDO
Enable full power-down. If SDO is high, Register 0x03
is set to 0xFF.
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AD9783BCPZRL 功能描述:IC DAC 16BT 500MSPS LVDS 72LFCSP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉(zhuǎn)換器 系列:- 產(chǎn)品培訓(xùn)模塊:Data Converter Fundamentals DAC Architectures 標(biāo)準(zhǔn)包裝:750 系列:- 設(shè)置時(shí)間:7µs 位數(shù):16 數(shù)據(jù)接口:并聯(lián) 轉(zhuǎn)換器數(shù)目:1 電壓電源:雙 ± 功率耗散（最大）:100mW 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-LCC（J 形引線） 供應(yīng)商設(shè)備封裝:28-PLCC（11.51x11.51） 包裝:帶卷 (TR) 輸出數(shù)目和類型:1 電壓，單極；1 電壓，雙極 采樣率（每秒）:143k
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