參數資料
型號： ADM6926
廠商： Electronic Theatre Controls, Inc.
英文描述： 26 port 10/100 Mbps Ethernet Switch Controller
中文描述： 26端口10/100 Mbps以太網交換機控制器
文件頁數： 12/85頁
文件大?。?/td> 4222K
代理商： ADM6926
ADM6926 Interface Description
2.2
Pin Description
ADM6926 pins are categorized into one of the following groups:
Section 2.2.1 SS-SMII Networking Interface, 60 pins
Section 2.2.2 MII/RMII Interface, 28pins
Section 2.2.3 Power/Ground
Section 2.2.4 Miscellaneous pins, 16 pins
2.2.1 SS-SMII Networking Interface, 60 pins
Name
Type
Pin #
SRXD0[0:7] I,
TTL
112,116,
120,124,
126,2
SYNC_RX0 I,
TTL
ADMtek Inc.
2-2
Description
Port 0 to Port 7 SS-SMII Receive Data bit.
The receive data
should be synchronous to the rising edge of CLK_RX0.
106,108,
115
Port 0 to Port 7 SS-SMII Synchronous signal.
This signal is
synchronous to the rising edge of CLK_RX0. Active high
indicates the byte boundary.
Reference Receive Clock for Port 0 to Port 7.
This signal is
125MHz input for SS-SMII interface.
Port 0 to Port 7 SS-SMII Transmit Data bit.
The transmit
data is synchronous to the rising edge of CLK_TX0.
CLK_RX0 I,
TTL
119
STXD0[0:7] O, TTL
8mA
104,107,
109,114,
118,123,
125,127
113
SYNC_TX0 O, TTL
8mA
Port 0 to Port 7 SS-SMII Synchronous signal.
This signal is
synchronous to the rising edge of CLK_TX0. Active high
indicates the byte boundary.
Reference Transmit Clock for Port 0 to Port 7.
This signal
is 125MHz output for SS-SMII interface.
Port 8 to Port 15 SS-SMII Receive Data bit.
The receive
data should be synchronous to the rising edge of CLK_RX1.
CLK_TX0 O, TTL
16mA
117
SRXD1[0:7] I,
TTL
4,8,10,26,
32,36,38,
40
25
SYNC_RX1 I,
TTL
Port 8 to Port 15 SS-SMII Synchronous signal.
This signal
is synchronous to the rising edge of CLK_RX1. Active high
indicates the byte boundary.
Reference Receive Clock for Port 8 to Port 15.
This signal
is 125MHz input for SS-SMII interface.
Port 8 to Port 15 SS-SMII Transmit Data bit.
The transmit
data is synchronous to the rising edge of CLK_TX1.
CLK_RX1 I,
TTL
31
STXD1[0:7] O, TTL
8mA
3,6,9,18,
30,33,37,
39
17
SYNC_TX1 O, TTL
8mA
Port 8 to Port 15 SS-SMII Synchronous signal.
This signal
is synchronous to the rising edge of CLK_TX1. Active high
indicates the byte boundary.
Reference Transmit Clock for Port 8 to Port 15.
This
CLK_TX1 O, TTL 27
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