Timing Requirements: tIALP Durat" />
參數(shù)資料
型號： ADSP-2183KCAZ-210
廠商： Analog Devices Inc
文件頁數(shù)： 11/31頁
文件大?。?/td> 0K
描述： IC DSP 16BIT 52MHZ 144-BGA
標(biāo)準(zhǔn)包裝： 1
系列： ADSP-21xx
類型： 定點(diǎn)
接口： 同步串行端口（SSP）
時鐘速率： 52MHz
非易失內(nèi)存： 外部
芯片上RAM： 80kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 144-LFBGA
供應(yīng)商設(shè)備封裝： 144-迷你型BGA
包裝： 托盤
ADSP-2183
–19–
REV. C
Parameter
Min
Max
Unit
IDMA Address Latch
Timing Requirements:
tIALP
Duration of Address Latch
1, 2
10
ns
tIASU
IAD15–0 Address Setup before Address Latch End
2
5ns
tIAH
IAD15–0 Address Hold after Address Latch End
2
2ns
tIKA
IACK Low before Start of Address Latch1
0ns
tIALS
Start of Write or Read after Address Latch End
2, 3
3ns
NOTES
1Start of Address Latch =
IS Low and IAL High.
2End of Address Latch =
IS High or IAL Low.
3Start of Write or Read =
IS Low and IWR Low or IRD Low.
tIKA
IAD15–0
IACK
IAL
IS
IRD OR
IWR
tIALP
tIASU
tIAH
tIALS
Figure 14. IDMA Address Latch
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PDF描述
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