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參數(shù)資料
型號(hào)： ADSP-2191MBCAZ-140
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 28/48頁(yè)
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 16BIT 144MBGA
標(biāo)準(zhǔn)包裝： 1
系列： ADSP-21xx
類型： 定點(diǎn)
接口： 主機(jī)接口，SPI，SSP，UART
時(shí)鐘速率： 140MHz
非易失內(nèi)存： 外部
芯片上RAM： 160kB
電壓 - 輸入/輸出： 3.00V，3.30V
電壓 - 核心： 2.50V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 144-LFBGA
供應(yīng)商設(shè)備封裝： 144-迷你型BGA
包裝： 托盤
ADSP-2191M
–34–
REV. A
Figure 18. Serial Ports
DT
tDDTTE
tDDTEN
tDDTTI
tDDTIN
DRIVE
EDGE
DRIVE
EDGE
DRIVE
EDGE
DRIVE
EDGE
TCLK/RCLK
TCLK (EXT)
TFS (“LATE,” EXT.)
tSDRI
RCLK
RFS
DR
DRIVE
EDGE
SAMPLE
EDGE
tHDRI
tSFSI
tHFSI
tDFSE
tHOFSE
tSCLKIW
DATA RECEIVE-INTERNAL CLOCK
tSDRE
DATA RECEIVE-EXTERNAL CLOCK
RCLK
RFS
DR
DRIVE
EDGE
SAMPLE
EDGE
tHDRE
tSFSE
tHFSE
tDFSE
tSCLKW
tHOFSE
NOTE: EITHER THE RISING EDGE OR FALLING EDGE OF RCLK OR TCLK CAN BE USED AS THE ACTIVE SAMPLING EDGE.
tDDTI
tHDTI
TCLK
TFS
DT
DRIVE
EDGE
SAMPLE
EDGE
tSFSI
tHFSI
tSCLKIW
tDFSE
tHOFSE
DATA TRANSMIT-INTERNAL CLOCK
tDDTE
tHDTE
TCLK
TFS
DT
DRIVE
EDGE
SAMPLE
EDGE
tSFSE
tHFSE
tDFSE
tSCLKW
tHOFSE
DATA TRANSMIT-EXTERNAL CLOCK
NOTE: EITHER THE RISING EDGE OR FALLING EDGE OF RCLK OR TCLK CAN BE USED AS THE ACTIVE SAMPLING EDGE.
TCLK (INT)
TFS (“LATE,” INT.)
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PDF描述
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