參數(shù)資料
型號(hào)： ADSP-BF537BBCZ-5BV
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 59/68頁(yè)
文件大小： 0K
描述： IC DSP CTLR 16BIT 208CSPBGA
產(chǎn)品培訓(xùn)模塊： Blackfin® Processor Core Architecture Overview
Blackfin® Device Drivers
Blackfin® Optimizations for Performance and Power Consumption
Blackfin® System Services
標(biāo)準(zhǔn)包裝： 1
系列： Blackfin®
類(lèi)型： 定點(diǎn)
接口： CAN，SPI，SSP，TWI，UART
時(shí)鐘速率： 533MHz
非易失內(nèi)存： 外部
芯片上RAM： 132kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.25V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 208-LFBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 208-CSPBGA
包裝： 托盤(pán)
配用： ADZS-BF537-ASKIT-ND - BOARD EVAL SKIT ADSP-BF537
ADZS-BFAUDIO-EZEXT-ND - BOARD EVAL AUDIO BLACKFIN
ADZS-BF537-EZLITE-ND - BOARD EVAL ADSP-BF537
ADZS-BFAV-EZEXT-ND - BOARD DAUGHT ADSP-BF533,37,61KIT
ADZS-BF537-STAMP-ND - SYSTEM DEV FOR ADSP-BF537
Rev. J
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February 2014
Figure 65 shows the top view of the CSP_BGA ball configura-
tion. Figure 66 shows the bottom view of the CSP_BGA ball
configuration.
Figure 65. 208-Ball CSP_BGA Configuration (Top View)
A
B
C
D
E
F
G
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J
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9
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16 17 18 19 20
15
VDDINT
VDDEXT
GND
I/O
KEY:
VROUT
VDDRTC
R
T
U
V
W
Y
Figure 66. 208-Ball CSP_BGA Configuration (Bottom View)
A
B
C
D
E
F
G
H
J
K
L
M
N
P
20 19 18 17 16 15 14 13 12 11 10
9
8
7
5
4
3
2
1
6
VDDINT
VDDEXT
GND
I/O
KEY:
VROUT
VDDRTC
R
T
U
V
W
Y
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PDF描述
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ECC22DJBN-S1136 CONN EDGECARD 44PS .100 PRESSFIT
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