- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄366557 > AMD-751 (Advanced Micro Devices, Inc.) System Bus, System Memory Controller, AGP Controller, and PCI Bus Controller(系統(tǒng)總線、系統(tǒng)存儲(chǔ)器控制器、AGP控制器和PCI總線控制器) PDF資料下載
參數(shù)資料
| 型號(hào)： | AMD-751 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | System Bus, System Memory Controller, AGP Controller, and PCI Bus Controller(系統(tǒng)總線、系統(tǒng)存儲(chǔ)器控制器、AGP控制器和PCI總線控制器) |
| 中文描述： | 系統(tǒng)總線，系統(tǒng)內(nèi)存控制器，AGP控制器和PCI總線控制器（系統(tǒng)總線，系統(tǒng)存儲(chǔ)器控制器，AGP接口控制器和的PCI總線控制器） |
| 文件頁數(shù)： | 59/236頁 |
| 文件大小： | 3578K |
| 代理商： | AMD-751 |
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Chapter 4
Signal Descriptions
37
21910D
—
August 1999
AMD-751
System Controller Data Sheet
Preliminary Information
4.4.7
A_IRDY# (Initiator Ready)
Bidirectional
Summary
As a target, the AMD-751 system controller samples A_IRDY#
to look for the beginning of a write transfer from the initiator
to determine if the initiator is ready to transfer a block. For an
AGP write transfer, all data in the given transaction is sent
without wait-states, so A_IRDY# only needs to be sampled once
for the entire transaction. An AGP read transfer can have
wait-states, so the AMD-751 must sample A_IRDY# asserted for
each block of a read transfer. A block is the amount of data
transferred in four SYSCLK cycles
—
four doublewords in 1x
mode and eight doublewords in 2x mode.
As an initiator, the AMD-751 system controller asserts
A_IRDY# to signal the AGP device that it is ready to begin a
transfer.
Note:
Because A_FRAME# is not used in an AGP transaction,
there is no relationship between A_FRAME# and A_IRDY#,
as there is in a PCI transaction.
Driven, Sampled, and
Floated
As an Output:
The AMD-751 system controller drives A_IRDY#
valid off the rising edge of SYSCLK. For AGP transfers,
A_IRDY# is asserted for one clock. For PCI transfers, it is
driven during the entire transaction.
As an Input:
When the AMD-751 system controller is a target, it
samples A_IRDY# on the rising edge of SYSCLK. For AGP
transfers, A_IRDY# is sampled only at the beginning of a cycle.
A_IRDY# is floated during reset and when there is no initiator
driving the bus.
4.4.8
A_PAR (PCI Bus Parity)
Bidirectional
Summary
A_PAR# is used for PCI transfers on the secondary PCI bus. Its
function is the same as that of PAR# on the primary PCI bus
(see page 26).
A_PAR# is not used during AGP transfers.
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