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參數(shù)資料
| 型號(hào)： | AOP-PXB4340 |
| 英文描述： | ATM OAM Processor |
| 中文描述： | 自動(dòng)柜員機(jī)的OAM處理器 |
| 文件頁數(shù)： | 113/185頁 |
| 文件大小： | 2552K |
| 代理商： | AOP-PXB4340 |
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3;%(
Data Sheet
3-113
04.2000
5HJLVWHU'HVFULSWLRQ
Bit 7
CCCMEN
0
F5 CC monitoring disabled.
1
F5 CC monitoring enabled.
State transition to LOC failure state and out of LOC failure
state is reported by use of the
μP interrupt DCSTTR.
Bit 6
CARIEN
0
F5 AIS or RDI Cell insertion disabled.
1
F5 AIS or RDI Cell insertion enabled.
Independent of the reason for cell generation (forced
insertion by ARINS, detected LOC or AIS state) AIS/RDI
cell generation is always controlled by this flag. Necessary
e.g. to suppress RDI at endpoints of multicast or
unidirectional connections.
Bit 5
CLOCFAI
F5 LOC failure state. Initialize to 0 at connection setup. Do not change
by μP in normal operation.
Bit 4
CLOCDEF
F5 LOC defect state. Initialize to 0 at connection setup. Do not change
by μP in normal operation.
Bit 3
CRDIFAI
F5 RDI failure state. Initialize to 0 at connection setup. Do not change
by μP in normal operation.
Bit 2
CRDIDEF
F5 RDI defect state. Initialize to 0 at connection setup. Do not change
by μP in normal operation.
Bit 1
CAISFAI
F5 AIS failure state. Initialize to 0 at connection setup. Do not change
by μP in normal operation.
Bit 0
CAISDEF
F5 AIS defect state. Initialize to 0 at connection setup. Do not change
by μP in normal operation.
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PDF描述 |
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