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參數(shù)資料
| 型號： | APA075-PQG208I |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 81/178頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA PROASIC+ 75K 208-PQFP |
| 標準包裝： | 24 |
| 系列： | ProASICPLUS |
| RAM 位總計： | 27648 |
| 輸入/輸出數(shù)： | 158 |
| 門數(shù)： | 75000 |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 208-BFQFP |
| 供應商設(shè)備封裝： | 208-PQFP（28x28） |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁當前第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁
ProASICPLUS Flash Family FPGAs
v5.9
4-3
v4.1
(continued)
updated.
were updated.
A note was added to Figure 2-45 FIFO Reset.
A note was added to Table 2-68 TJ = 0°C to 110°C; VDD = 2.3 V to 2.7 V for Commercial/
The "TRST Test Reset Input" section was updated in the "Pin Description" section.
The "624-Pin CCGA/LGA" section was updated for the APA600 and APA1000. Please review all
pin data.
v4.0
Figure 2-17 Using the PLL for Clock Deskewing was updated.
Table 2-48 Recommended Operating Conditions was updated.
The "1152-Pin FBGA" figure was updated.
Pin names were changed to more accurately reflect the multiple functions supported by each
pin.
v3.5
The ProASICPLUS and ProASICPLUS Military/Aerospace datasheets were combined. This
document now supports Commercial, Industrial, and Military Temperature devices.
Table 1 ProASICPLUS Product Profile was updated.
The "Ordering Information" section was updated.
"Plastic Device Resources" table was updated.
ii
The Long Term Jitter Peak-to-Peak Max. in the "PLL Electrical Specifications" table was updated.
The "Calculating Typical Power Dissipation" section was updated.
Table 2-21 Recommended Operating Conditions was updated.
Table 2-48 Recommended Operating Conditions was updated.
v3.4
The "Temperature Grade Offerings" table is new.
The "Speed Grade and Temperature Matrix" table is new.
The "ProASICPLUS Clock Management System" section was updated.
The "Lock Signal" section was updated.
The "PLL Electrical Specifications" table was updated.
The "User Security" section was updated.
The "Design Environment" section was updated.
Table 2-16 Package Thermal Characteristics was updated.
The "Asynchronous FIFO Full and Empty Transitions" section was updated.
The "AVDD PLL Power Supply" section in the "Pin Description" section was updated.
v3.3
The "144-Pin TQFP" table was updated. The following pins changed:
Pin 15 = GLMX1
Pin 16 = GL1
Pin 21 = GL2
Pin 88 = GL3
Pin93 = GL4
Pin 94 = GLMX2
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Changes in current version (v5.9)
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| RSA50DRSI-S288 | CONN EDGECARD 100PS .125 EXTEND |
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參數(shù)描述 |
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| APA075-PQGM | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA075-PQGPP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
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