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參數(shù)資料
| 型號： | AT89LP51-20MU |
| 廠商： | Atmel |
| 文件頁數(shù)： | 106/117頁 |
| 文件大小： | 0K |
| 描述： | MCU 8051 4K FLASH 20MHZ 7X7MLF |
| 標(biāo)準(zhǔn)包裝： | 360 |
| 系列： | 89LP |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 連通性： | EBI/EMI，I²C，SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 36 |
| 程序存儲器容量： | 4KB（4K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 256 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.4 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 44-VFQFN 裸露焊盤 |
| 包裝： | 托盤 |
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89
3709D–MICRO–12/11
AT89LP51/52
Figure 17-11. In-System Programming (ISP) Start Sequence
17.9.4
ISP Exit Sequence
Execute this sequence to exit ISP mode and resume CPU execution mode.
1.
Drive SCK low.
1.
Wait at least t
SSD.
2.
Tristate MOSI.
3.
Wait at least t
RHZ and bring RST low.
4.
Wait t
SSZ and tristate SCK.
Figure 17-12. In-System Programming (ISP) Exit Sequence
Note:
The waveforms on this page are not to scale.
17.9.5
Serial Peripheral Interface
The Serial Peripheral Interface (SPI) is a byte-oriented full-duplex synchronous serial communi-
cation channel. During In-System Programming, the programmer always acts as the SPI master
and the target device always acts as the SPI slave. The target device receives serial data on
MOSI and outputs serial data on MISO. The Programming Interface implements a standard
SPI Port with a fixed data order and For In-System Programming, bytes are transferred MSB
first as shown in Figure 17-13. The SCK phase and polarity follow SPI clock mode 0 (CPOL = 0,
CPHA = 0) where bits are sampled on the rising edge of SCK and output on the falling edge of
SCK. For more detailed timing information see Figure 17-14.
tSTL
VDD
RST
SCK
HIGH Z
MOSI
HIGH Z
MISO
XTAL1
tRLZ
tZSS
tSSE
VDD
RST
SCK
HIGH Z
MOSI
HIGH Z
MISO
XTAL1
tSSZ
tSSD
tRHZ
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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