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參數(shù)資料
| 型號(hào)： | ATTINY2313 |
| 廠商： | Atmel Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | -bit AVR Microcontroller with 8K Bytes In- System Programmable Flash |
| 中文描述： | 位AVR微控制器具有8K字節(jié)的系統(tǒng)內(nèi)可編程閃存 |
| 文件頁數(shù)： | 44/226頁 |
| 文件大?。?/td> | 3676K |
| 代理商： | ATTINY2313 |
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138
2543L–AVR–08/10
ATtiny2313
Universal Serial
Interface – USI
The Universal Serial Interface, or USI, provides the basic hardware resources needed for serial
communication. Combined with a minimum of control software, the USI allows significantly
higher transfer rates and uses less code space than solutions based on software only. Interrupts
are included to minimize the processor load. The main features of the USI are:
Two-wire Synchronous Data Transfer (Master or Slave, f
SCLmax = fCK/16)
Three-wire Synchronous Data Transfer (Master, fSCKmax = fCK/2, Slave fSCKmax = fCK/4)
Data Received Interrupt
Wake-up from Idle Mode
In Two-wire Mode: Wake-up from All Sleep Modes, Including Power-down Mode
Two-wire Start Condition Detector with Interrupt Capability
Overview
A simplified block diagram of the USI is shown on Figure 60. For the actual placement of I/O
pins, refer to “Pinout ATtiny2313” on page 2. CPU accessible I/O Registers, including I/O bits
and I/O pins, are shown in bold. The device-specific I/O Register and bit locations are listed in
Figure 60. Universal Serial Interface, Block Diagram
The 8-bit Shift Register is directly accessible via the data bus and contains the incoming and
outgoing data. The register has no buffering so the data must be read as quickly as possible to
ensure that no data is lost. The most significant bit is connected to one of two output pins
depending of the wire mode configuration. A transparent latch is inserted between the serial reg-
ister output and output pin, which delays the change of data output to the opposite clock edge of
the data input sampling. The serial input is always sampled from the Data Input (DI) pin indepen-
dent of the configuration.
The 4-bit counter can be both read and written via the data bus, and can generate an overflow
interrupt. Both the serial register and the counter are clocked simultaneously by the same clock
source. This allows the counter to count the number of bits received or transmitted and generate
an interrupt when the transfer is complete. Note that when an external clock source is selected
the counter counts both clock edges. In this case the counter counts the number of edges, and
not the number of bits. The clock can be selected from three different sources: The USCK pin,
Timer0 overflow, or from software.
DATA
BUS
USIPF
USITC
USICLK
USICS0
USICS1
USIOIF
USIOIE
USIDC
USISIF
USIWM0
USIWM1
USISIE
Bit7
Two-wire Clock
Control Unit
DO
(Output only)
DI/SDA
(Input/Open Drain)
USCK/SCL
(Input/Open Drain)
4-bit Counter
USIDR
USISR
DQ
LE
USICR
CLOCK
HOLD
TIM0 OVF
Bit0
[1]
3
0
1
2
3
0
1
2
0
1
2
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ATMEGA128 | -bit AVR Microcontroller with 8K Bytes In- System Programmable Flash |
| AT93C56AU3-10UI-1.8 | 3-wire Serial EEPROMs 2K (256 x 8 or 128 x 16) |
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| AT93C56AW-10SI-2.7 | 3-wire Serial EEPROMs 2K (256 x 8 or 128 x 16) |
相關(guān)代理商/技術(shù)參數(shù) |
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