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參數(shù)資料
| 型號： | ATTINY2313 |
| 廠商： | Atmel Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | -bit AVR Microcontroller with 8K Bytes In- System Programmable Flash |
| 中文描述： | 位AVR微控制器具有8K字節(jié)的系統(tǒng)內(nèi)可編程閃存 |
| 文件頁數(shù)： | 45/226頁 |
| 文件大小： | 3676K |
| 代理商： | ATTINY2313 |
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139
2543L–AVR–08/10
ATtiny2313
The Two-wire clock control unit can generate an interrupt when a start condition is detected on
the Two-wire bus. It can also generate wait states by holding the clock pin low after a start con-
dition is detected, or after the counter overflows.
Functional
Descriptions
Three-wire Mode
The USI Three-wire mode is compliant to the Serial Peripheral Interface (SPI) mode 0 and 1, but
does not have the slave select (SS) pin functionality. However, this feature can be implemented
in software if necessary. Pin names used by this mode are: DI, DO, and USCK.
Figure 61. Three-wire Mode Operation, Simplified Diagram
Figure 61 shows two USI units operating in Three-wire mode, one as Master and one as Slave.
The two Shift Registers are interconnected in such way that after eight USCK clocks, the data in
each register are interchanged. The same clock also increments the USI’s 4-bit counter. The
Counter Overflow (interrupt) Flag, or USIOIF, can therefore be used to determine when a trans-
fer is completed. The clock is generated by the Master device software by toggling the USCK pin
via the PORT Register or by writing a one to the USITC bit in USICR.
Figure 62. Three-wire Mode, Timing Diagram
SLAVE
MASTER
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
DO
DI
USCK
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
DO
DI
USCK
PORTxn
MSB
654321
LSB
1
2
3
4
5
6
7
8
654321
LSB
USCK
DO
DI
D
C
B
A
E
CYCLE ( Reference )
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ATMEGA128 | -bit AVR Microcontroller with 8K Bytes In- System Programmable Flash |
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| AT93C56AW-10SI-1.8 | 3-wire Serial EEPROMs 2K (256 x 8 or 128 x 16) |
| AT93C56AW-10SI-2.7 | 3-wire Serial EEPROMs 2K (256 x 8 or 128 x 16) |
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參數(shù)描述 |
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