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參數資料
| 型號： | C8051T600SDB |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數： | 146/188頁 |
| 文件大小： | 0K |
| 描述： | BOARD SOCKET DAUGHTER SOIC |
| 標準包裝： | 1 |
| 模塊/板類型： | SOIC 插座模塊 |
| 適用于相關產品： | C8051T600DK |
| 其它名稱： | 336-1405 |
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C8051T600/1/2/3/4/5/6
60
Rev. 1.2
externally driven from –0.25 V to (VDD) + 0.25 V without damage or upset. The complete Comparator elec-
trical specifications are given in Section “8. Electrical Characteristics” on page 30.
The Comparator response time may be configured in software via the CPT0MD register (see SFR Defini-
tion 13.2). Selecting a longer response time reduces the Comparator supply current.
Figure 13.2. Comparator Hysteresis Plot
The Comparator hysteresis is software-programmable via its Comparator Control register CPT0CN. The
user can program both the amount of hysteresis voltage (referred to as the input voltage) and the positive
and negative-going symmetry of this hysteresis around the threshold voltage.
The Comparator hysteresis is programmed using Bits3–0 in the Comparator Control Register CPT0CN
(shown in SFR Definition 13.1). The amount of negative hysteresis voltage is determined by the settings of
the CP0HYN bits. As shown in Figure 13.2, settings of 20, 10 or 5 mV of negative hysteresis can be pro-
grammed, or negative hysteresis can be disabled. In a similar way, the amount of positive hysteresis is
determined by the setting the CP0HYP bits.
Comparator interrupts can be generated on both rising-edge and falling-edge output transitions. (For Inter-
rupt enable and priority control, see Section “17.1. MCU Interrupt Sources and Vectors” on page 81). The
CP0FIF flag is set to logic 1 upon a Comparator falling-edge occurrence, and the CP0RIF flag is set to
logic 1 upon the Comparator rising-edge occurrence. Once set, these bits remain set until cleared by soft-
ware.
The output state of the Comparator can be obtained at any time by reading the CP0OUT bit. The Compar-
ator is enabled by setting the CP0EN bit to logic 1, and is disabled by clearing this bit to logic 0.
Positive Hysteresis Voltage
(Programmed with CP0HYP Bits)
Negative Hysteresis Voltage
(Programmed by CP0HYN Bits)
VIN-
VIN+
INPUTS
CIRCUIT CONFIGURATION
+
_
CP0+
CP0-
CP0
VIN+
VIN-
OUT
VOH
Positive Hysteresis
Disabled
Maximum
Positive Hysteresis
Negative Hysteresis
Disabled
Maximum
Negative Hysteresis
OUTPUT
VOL
相關PDF資料 |
PDF描述 |
|---|---|
| C8051T606TDB | CARD DAUGHTER MSOP SOCKET |
| IDC5020ER102M | INDUCTOR POWER 1000UH 0.3A SMD |
| IDC5020ER101M | INDUCTOR POWER 100UH 1.3A SMD |
| IDC5020ER100M | INDUCTOR POWER 10UH 3.9A SMD |
| PN-F672-E3 | ADAPTER 672-FPBGA LATTICEECP3 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| C8051T600-SDB | 制造商:Silicon Laboratories Inc 功能描述:Evaluation Board For Mixed Signal OTP EPROM MCU Family 制造商:Silicon Laboratories Inc 功能描述:SOIC SOCKET DAUGHTER BOARD FOR C8051T60X - Boxed Product (Development Kits) |
| C8051T601 | 制造商:SILABS 制造商全稱:SILABS 功能描述:Mixed Signal OTP EPROM MCU Family |
| C8051T601-GM | 功能描述:8位微控制器 -MCU 8K OTP 11Pin QFN RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數據總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| C8051T601-GMR | 功能描述:8位微控制器 -MCU 8K OTP 11Pin QFN RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數據總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| C8051T601-GS | 功能描述:8位微控制器 -MCU 8K OTP 14Pin SOIC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數據總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
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