參數(shù)資料
型號: CAN-OBD-RD
廠商: Silicon Laboratories Inc
文件頁數(shù): 204/312頁
文件大?。?/td> 0K
描述: KIT REF DESIGN CAN DIAGNOSTIC
標(biāo)準(zhǔn)包裝: 1
主要目的: 接口,CAN OBD 讀取器
嵌入式: 是,MCU,8 位
已用 IC / 零件: C8051F502
主要屬性: CAN 板載診斷(OBD-II)參考設(shè)計
次要屬性: 支持模式 1、2 和 3,500kbps
已供物品: 板,ToolStick 適配器,線纜,CD,文檔
產(chǎn)品目錄頁面: 626 (CN2011-ZH PDF)
相關(guān)產(chǎn)品: 336-1515-5-ND - IC 8051 MCU 64K FLASH 32-QFN
336-1514-ND - IC 8051 MCU 64K FLASH 32-QFP
其它名稱: 336-1559
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C8051F50x/F51x
282
Rev. 1.2
The TF3H bit is set when TMR3H overflows from 0xFF to 0x00; the TF3L bit is set when TMR3L overflows
from 0xFF to 0x00. When Timer 3 interrupts are enabled, an interrupt is generated each time TMR3H over-
flows. If Timer 3 interrupts are enabled and TF3LEN (TMR3CN.5) is set, an interrupt is generated each
time either TMR3L or TMR3H overflows. When TF3LEN is enabled, software must check the TF3H and
TF3L flags to determine the source of the Timer 3 interrupt. The TF3H and TF3L interrupt flags are not
cleared by hardware and must be manually cleared by software.
Figure 26.8. Timer 3 8-Bit Mode Block Diagram
26.3.3. External Oscillator Capture Mode
Capture Mode allows the external oscillator to be measured against the system clock. Timer 3 can be
clocked from the system clock, or the system clock divided by 12, depending on the T3ML (CKCON.6),
and T3XCLK bits. When a capture event is generated, the contents of Timer 3 (TMR3H:TMR3L) are
loaded into the Timer 3 reload registers (TMR3RLH:TMR3RLL) and the TF3H flag is set. A capture event
is generated by the falling edge of the clock source being measured, which is the external oscillator/8. By
recording the difference between two successive timer capture values, the external oscillator frequency
can be determined with respect to the Timer 3 clock. The Timer 3 clock should be much faster than the
capture clock to achieve an accurate reading. Timer 3 should be in 16-bit auto-reload mode when using
Capture Mode.
If the SYSCLK is 24 MHz and the difference between two successive captures is 5861, then the external
clock frequency is as follows:
24 MHz/(5861/8) = 0.032754 MHz or 32.754 kHz
This mode allows software to determine the external oscillator frequency when an RC network or capacitor
is used to generate the clock source.
T3MH
T3XCLK TMR3H Clock Source
T3ML
T3XCLK TMR3L Clock Source
0
SYSCLK/12
0
SYSCLK/12
0
1
External Clock/8
0
1
External Clock/8
1
X
SYSCLK
1
X
SYSCLK
TCLK
0
1
TR3
External Clock / 8
SYSCLK / 12
0
1
T3XCLK
1
0
TMR3H
TMR3RLH
Reload
TCLK
TMR3L
TMR3RLL
Interrupt
TMR
3
CN
T3SPLIT
TF3CEN
TF3LEN
TF3L
TF3H
T3XCLK
TR3
To ADC,
SMBus
To SMBus
CKCON
T
3
M
H
T
3
M
L
S
C
A
0
S
C
A
1
T
0
M
T
2
M
H
T
2
M
L
T
1
M
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PDF描述
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