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參數資料
| 型號： | CAN-OBD-RD |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數： | 218/312頁 |
| 文件大?。?/td> | 0K |
| 描述： | KIT REF DESIGN CAN DIAGNOSTIC |
| 標準包裝： | 1 |
| 主要目的： | 接口，CAN OBD 讀取器 |
| 嵌入式： | 是，MCU，8 位 |
| 已用 IC / 零件： | C8051F502 |
| 主要屬性： | CAN 板載診斷（OBD-II）參考設計 |
| 次要屬性： | 支持模式 1、2 和 3，500kbps |
| 已供物品： | 板，ToolStick 適配器，線纜，CD，文檔 |
| 產品目錄頁面： | 626 (CN2011-ZH PDF) |
| 相關產品： | 336-1515-5-ND - IC 8051 MCU 64K FLASH 32-QFN 336-1514-ND - IC 8051 MCU 64K FLASH 32-QFP |
| 其它名稱： | 336-1559 |
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Rev. 1.2
295
C8051F50x/F51x
Figure 27.8. PCA 8-Bit PWM Mode Diagram
27.3.5.2. 9/10/11-bit Pulse Width Modulator Mode
The duty cycle of the PWM output signal in 9/10/11-bit PWM mode should be varied by writing to an “Auto-
Reload” Register, which is dual-mapped into the PCA0CPHn and PCA0CPLn register locations. The data
written to define the duty cycle should be right-justified in the registers. The auto-reload registers are
accessed (read or written) when the bit ARSEL in PCA0PWM is set to 1. The capture/compare registers
are accessed when ARSEL is set to 0.
When the least-significant N bits of the PCA0 counter match the value in the associated module’s cap-
ture/compare register (PCA0CPn), the output on CEXn is asserted high. When the counter overflows from
the Nth bit, CEXn is asserted low (see Figure 27.9). Upon an overflow from the Nth bit, the COVF flag is
set, and the value stored in the module’s auto-reload register is loaded into the capture/compare register.
The value of N is determined by the CLSEL bits in register PCA0PWM.
The 9, 10 or 11-bit PWM mode is selected by setting the ECOMn and PWMn bits in the PCA0CPMn regis-
ter, and setting the CLSEL bits in register PCA0PWM to the desired cycle length (other than 8-bits). If the
MATn bit is set to 1, the CCFn flag for the module will be set each time a comparator match (rising edge)
occurs. The COVF flag in PCA0PWM can be used to detect the overflow (falling edge), which will occur
every 512 (9-bit), 1024 (10-bit) or 2048 (11-bit) PCA clock cycles. The duty cycle for 9/10/11-Bit PWM
Mode is given in Equation 27.2, where N is the number of bits in the PWM cycle.
Important Note About PCA0CPHn and PCA0CPLn Registers: When writing a 16-bit value to the
PCA0CPn registers, the low byte should always be written first. Writing to PCA0CPLn clears the ECOMn
bit to 0; writing to PCA0CPHn sets ECOMn to 1.
Equation 27.3. 9, 10, and 11-Bit PWM Duty Cycle
A 0% duty cycle may be generated by clearing the ECOMn bit to 0.
8-bit
Comparator
PCA0L
PCA0CPLn
PCA0CPHn
CEXn
Crossbar
Port I/O
Enable
Overflow
PCA Timebase
00 x 0
x
Q
SET
CLR
S
R
match
PCA0CPMn
P
W
M
1
6
n
E
C
O
M
n
E
C
F
n
T
O
G
n
P
W
M
n
C
A
P
n
C
A
P
N
n
M
A
T
n
0
PCA0PWM
A
R
S
E
L
C
O
V
F
C
L
S
E
L
0
C
L
S
E
L
1
E
C
O
V
x0
0
ENB
0
1
Write to
PCA0CPLn
Write to
PCA0CPHn
Reset
COVF
Duty Cycle
2N
PCA0CPn
–
2N
------------------------------------------------
=
相關PDF資料 |
PDF描述 |
|---|---|
| V300C12T75BF | CONVERTER MOD DC/DC 12V 75W |
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| GBC44DCSN | CONN EDGECARD 88POS DIP .100 SLD |
| RCC18DCST-S288 | CONN EDGECARD 36POS .100 EXTEND |
相關代理商/技術參數 |
參數描述 |
|---|---|
| CANOP | 功能描述:界面模塊 CAN OPTICAL REPEATER W/TB RoHS:否 制造商:B&B Electronics (Quatech) 產品: 通道/端口數量: 數據速率: 接口類型: 工作電源電壓: 最大工作溫度: |
| CAN-OPEN-96F340-P-P1-A | 制造商:Micrium 功能描述:UC/CAN, OPEN SENSOR SLAVE, FOR FUJITSU MB96F340, Software Application:Libraries |
| CAN-OPEN-96F340-P-P1-B | 制造商:Micrium 功能描述:UC/CAN, OPEN SENSOR SLAVE, FOR FUJITSU MB96F340, Software Application:Libraries 制造商:Micrium 功能描述:UC/CAN, OPEN SENSOR SLAVE, FOR FUJITSU MB96F340, Software Application:Libraries - CAN, Core Architecture:F2MC, Core Sub-Architecture:16FX, Supported Families:-, License Model:Product Line , RoHS Compliant: NA |
| CAN-OPEN-96F340-P-P1-C | 制造商:Micrium 功能描述:UC/CAN, OPEN SENSOR SLAVE, FOR FUJITSU MB96F340, Software Application:Libraries |
| CAN-OPEN-96F340-P-P1-PLATFORM | 制造商:Micrium 功能描述:UC/CAN OPEN SENSOR SLAVE MB96F340 制造商:Micrium 功能描述:UC/CAN, OPEN SENSOR SLAVE, MB96F340 |
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