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參數(shù)資料
| 型號： | CDC2509BPWG4 |
| 廠商： | Texas Instruments |
| 文件頁數(shù)： | 13/14頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PLL CLOCK DVR 3.3V 24-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 類型： | PLL 時鐘驅(qū)動器 |
| PLL： | 帶旁路 |
| 輸入： | LVTTL |
| 輸出： | LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:9 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 125MHz |
| 除法器/乘法器： | 無/無 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 24-TSSOP |
| 包裝： | 管件 |
CDC2509B
3.3V PHASELOCK LOOP CLOCK DRIVER
SCAS613C SEPTEMBER 1998 REVISED DECEMBER 2004
8
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
TYPICAL CHARACTERISTICS
Figure 5
PHASE ERROR
vs
SUPPLY VOLTAGE
300
250
150
100
50
0
200
Phase
Error
ps
2.9
3.0
3.1
3.2
3.3
3.4
3.5
3.6
3.7
350
400
50
100
fc = 100 MHz
CLY = CLF = 30 pF
TA = 25°C
Phase Error Measured
from CLK to FBIN
VCC Supply Voltage V
Figure 6
JITTER
vs
CLOCK FREQUENCY
400
300
250
200
0
350
Jitter
ps
35
45
55
65
75
85
95
105 115 125
150
100
50
Cycle to Cycle
Peak to Peak
VCC = 3.3 V
TA = 25°C
fc Clock Frequency MHz
Figure 7
ANALOG SUPPLY CURRENT
vs
CLOCK FREQUENCY
12
10
6
4
2
0
8
10
20
40
60
80
100
120
140
14
16
AVCC = 3.6 V
Bias = 0/3 V
CLY = CLF = 30 pF
TA = 25°C
fc Clock Frequency MHz
AI
CC
Analog
Supply
Current
mA
Figure 8
0
50
100
150
200
250
20
40
60
80
100
120
140
SUPPLY CURRENT
vs
CLOCK FREQUENCY
fclk Clock Frequency MHz
VCC = 3.6 V
TA = 25°C
CLY = CLF = 30 pF
I CC
Supply
Current
mA
NOTES: A. CLY = Lumped capacitive load at Y
B. CLF = Lumped feedback capacitance at FBIN
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| CDC2509C | 制造商:TI 制造商全稱:Texas Instruments 功能描述:3.3-V PHASE-LOCK LOOP CLOCK DRIVER |
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