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參數(shù)資料
| 型號： | CS4265-CNZ |
| 廠商： | Cirrus Logic Inc |
| 文件頁數(shù)： | 36/46頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CODEC 24BIT 104DB 32QFN |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 類型： | 立體聲音頻 |
| 數(shù)據(jù)接口： | PCM 音頻接口 |
| 分辨率（位）： | 24 b |
| ADC / DAC 數(shù)量： | 2 / 2 |
| 三角積分調(diào)變： | 是 |
| 動態(tài)范圍，標(biāo)準(zhǔn) ADC / DAC (db)： | 104 / 104 |
| 電壓 - 電源，模擬： | 3.13 V ~ 5.25 V |
| 電壓 - 電源，數(shù)字： | 3.13 V ~ 5.25 V |
| 工作溫度： | -10°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-QFN |
| 供應(yīng)商設(shè)備封裝： | 32-QFN 裸露焊盤（5x5） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 754 (CN2011-ZH PDF) |
| 配用： | 598-1001-ND - BOARD EVAL FOR CS4265 CODEC |
| 其它名稱： | 598-1039 |
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DS657F3
41
CS4265
6.9
ADC Input Control - Address 09h
6.9.1
PGA Soft Ramp or Zero Cross Enable (Bits 4:3)
Function:
Soft Ramp Enable
Soft Ramp allows level changes, both muting and attenuation, to be implemented by incrementally ramp-
ing, in 1/8 dB steps, from the current level to the new level at a rate of 1 dB per 8 left/right clock periods.
See Table 14.
Zero Cross Enable
Zero Cross Enable dictates that signal-level changes, either by attenuation changes or muting, will occur
on a signal zero crossing to minimize audible artifacts. The requested level change will occur after a time-
out period between 512 and 1024 sample periods (10.7 ms to 21.3 ms at 48 kHz sample rate) if the signal
does not encounter a zero crossing. The zero cross function is independently monitored and implemented
for each channel. See Table 14.
Soft Ramp and Zero Cross Enable
Soft Ramp and Zero Cross Enable dictate that signal-level changes, either by attenuation changes or mut-
ing, will occur in 1/8 dB steps and be implemented on asignal zero crossing. The 1/8 dB level change will
occur after a time-out period between 512 and 1024 sample periods (10.7 ms to 21.3 ms at 48 kHz sam-
ple rate) if the signal does not encounter a zero crossing. The zero cross function is independently mon-
itored and implemented for each channel. See Table 14.
6.9.2
Analog Input Selection
(Bit 0)
Function:
These bits are used to select the input source for the PGA and ADC. Please see Table 15.
6.10
DAC Channel A Volume Control - Address 0Ah
7
65
432
10
Reserved
PGASoft
PGAZero
Reserved
Select
PGASoft
PGAZeroCross
Mode
0
Changes to affect immediately
0
1
Zero Cross enabled
1
Soft Ramp enabled
1
Soft Ramp and Zero Cross enabled (default)
Table 14. PGA Soft Cross or Zero Cross Mode Selection
Select
PGA/ADC Input
0
Microphone-Level Input
1
Line-Level Input
Table 15. Analog Input Selection
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CS4270-DZZ | IC CODEC 24BIT 105DB 24TSSOP |
| CS4271-DZZ | IC CODEC 24BIT 114DB 28-TSSOP |
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| CS42L51-DNZ | IC CODEC STEREO W/HDPN AMP 32QFN |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| CS4265-DNZ | 功能描述:接口—CODEC Stereo Audio CODEC 104 dB 192 kHz RoHS:否 制造商:Texas Instruments 類型: 分辨率: 轉(zhuǎn)換速率:48 kSPs 接口類型:I2C ADC 數(shù)量:2 DAC 數(shù)量:4 工作電源電壓:1.8 V, 2.1 V, 2.3 V to 5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DSBGA-81 封裝:Reel |
| CS4265-DNZR | 功能描述:接口—CODEC IC 24-bit 192kHz Str Cdc w/PGA &Inpt Mux RoHS:否 制造商:Texas Instruments 類型: 分辨率: 轉(zhuǎn)換速率:48 kSPs 接口類型:I2C ADC 數(shù)量:2 DAC 數(shù)量:4 工作電源電壓:1.8 V, 2.1 V, 2.3 V to 5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DSBGA-81 封裝:Reel |
| CS4267AM | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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