參數(shù)資料
型號(hào)： CY7C1031-8NC
廠商： CYPRESS SEMICONDUCTOR CORP
元件分類： SRAM
英文描述： 64K X 18 CACHE SRAM, 8.5 ns, PQFP52
封裝： PLASTIC, QFP-52
文件頁(yè)數(shù)： 8/14頁(yè)
文件大小： 343K
代理商： CY7C1031-8NC
CY7C1031
CY7C1032
PRELIMINARY
3
Figure 1. Cache Using Four CY7C1031s
PENTIUM
CLK
DATA
ADR
66–MHz OSC
CACHE
CLK
DATA
ADR
CLK
DATA
ADR
MATCH
DIRTY
VALID
MATCH
DIRTY
VALID
CD
ADSP
ADSC ADV OE
WH0,
WL0
CACHE
CONTROLLER
CLK
DATA
ADR
ADSP
ADSC
ADV
OE
WH, WL
512 KB
7C1031
INTERFACE TO
MAIN MEMORY
WH,WL
WH1,
WL1
WH2,
WL2
WH3,
WL3
2
22
ADS
PROCESSOR
TAG
Pin Definitions
Signal Name
Type
# of Pins
Description
VCC
Input
1
+5V Power
VCCQ
Input
4
+5V or 3.3V (Outputs)
GND
Input
1
Ground
VSSQ
Input
4
Ground (Outputs)
CLK
Input
1
Clock
A15 – A0
Input
16
Address
ADSP
Input
1
Address Strobe from Processor
ADSC
Input
1
Address Strobe from Cache Controller
WH
Input
1
Write Enable – High Byte
WL
Input
1
Write Enable – Low Byte
ADV
Input
1
Advance
OE
Input
1
Output Enable
CS
Input
1
Chip Select
DQ15–DQ0
Input/Output
16
Regular Data
DP1–DP0
Input/Output
2
Parity Data
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PDF描述
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