參數(shù)資料
型號(hào)： DS21448L
廠商： Maxim Integrated Products
文件頁數(shù)： 15/60頁
文件大?。?/td> 0K
描述： IC LIU QUAD E1/T1/J1 128-LQFP
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
產(chǎn)品變化通告： Product Discontinuation 20/Feb/2012
標(biāo)準(zhǔn)包裝： 72
類型： 線路接口裝置（LIU）
驅(qū)動(dòng)器/接收器數(shù)： 4/4
規(guī)程： T1/E1/J1
電源電壓： 3.135 V ~ 3.465 V
安裝類型： 表面貼裝
封裝/外殼： 128-LQFP
供應(yīng)商設(shè)備封裝： 128-LQFP（14x20）
包裝： 管件
DS21448 3.3V T1/E1/J1 Quad Line Interface
22 of 60
Table 4-I. Receive Sensitivity Settings
EGL
(CCR4.4)
ETS
(CCR1.7)
RECEIVE SENSITIVITY
(dB)
0
0 (E1)
-12 (short haul)
1
0 (E1)
-43 (long haul)
1
1 (T1)
-30 (limited long haul)
0
1 (T1)
-36 (long haul)
CCR5 (04H): Common Control Register 5
(MSB)
(LSB)
BPCS1
BPCS0
MM1
MM0
RSCLKE
TSCLKE
RT1
RT0
NAME
POSITION
FUNCTION
BPCS1
CCR5.7
Backplane Clock Frequency Select 1. See Table 4-J for details.
BPCS0
CCR5.6
Backplane Clock Frequency Select 0. See Table 4-J for details.
MM1
CCR5.5
Monitor Mode Gain Select 1 (Table 4-K. )
MM0
CCR5.4
Monitor Mode Gain Select 0. See (Table 4-K.
RSCLKE
CCR5.3
Receive Synchronization Clock Enable
0 = disable 2.048MHz synchronization receive mode
1 = enable 2.048MHz synchronization receive mode
TSCLKE
CCR5.2
Transmit Synchronization Clock Enable
0 = disable 2.048MHz transmit synchronization clock
1 = enable 2.048MHz transmit synchronization clock
RT1
CCR5.1
Receive Termination Select 1. See Table 4-L for details.
RT0
CCR5.0
Receive Termination Select 0. See Table 4-L for details.
Table 4-J. Backplane Clock Select
BPCS1
(CCR5.7)
BPCS0
(CCR5.6)
BPCLK FREQUENCY (MHz)
0
16.384
0
1
8.192
1
0
4.096
1
2.048
Table 4-K. Monitor Gain Settings
MM1
(CCR5.5)
MM0
(CCR5.4)
INTERNAL LINEAR GAIN
BOOST (dB)
0
Normal operation (no boost)
0
1
20
1
0
26
1
32
Table 4-L. Internal Rx Termination Select
RT1
(CCR5.1)
RT0
(CCR5.0)
INTERNAL RECEIVE
TERMINATION CONFIGURATION
0
Internal receive-side termination disabled
0
1
Internal receive-side 120
enabled
1
0
Internal receive-side 100
enabled
1
Internal receive-side 75
enabled
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PDF描述
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參數(shù)描述
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