參數(shù)資料
型號： DS26401DK
廠商： Maxim Integrated Products
文件頁數(shù)： 187/309頁
文件大?。?/td> 0K
描述： KIT DESIGN FOR DS26401
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
設(shè)計資源： DS26401DK Gerber Files
標(biāo)準(zhǔn)包裝： 1
主要目的： 電信，調(diào)幀器
已用 IC / 零件： DS26401
已供物品： 板，子卡，CD
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DS26401 Octal T1/E1/J1 Framer
267
12.7 BERT Control Registers
Register Name:
BCR1
Register Description:
BERT Control Register 1
Register Address:
2F0h
Bit #
7
6
5
4
3
2
1
0
Name
BSYNCE
BRESYNC
LC
LPBK
QRSS
PS
LSB
TL
Default
0
Bit 0 / Transmit Load (TL).
A rising edge causes the transmit shift register to be loaded with the seed value.
Bit 1 / LSB/MSB (LSB)
0 = Repetitive Pattern data is transmitted/received MSB first.
1 = Repetitive Pattern data is transmitted/received LSB first.
Bit 2 / Pattern Select (PS)
0 = Pseudorandom pattern.
1 = Repetitive pattern.
Bit 3 / Zero Suppression Select (QRSS).
Forces a 1 into the pattern whenever the next 14 bit positions are all 0s.
Should only be set when using the QRSS pattern.
0 = Disable 14 zero suppression.
1 = Enable 14 zero suppression per T1.403.
Bit 4 / Transmit/Receive Loopback Select (LPBK)
0 = Loop back disabled.
1 = Loop back enabled.
Bit 5 / Latch Count Registers (LC).
A rising edge copies the bit count and bit error count accumulators to the
appropriate registers. The accumulators are then cleared.
Bit 6 / Initiate Manual Resync Process (BRESYNC).
A rising edge causes the device to go out of sync and begin
resynchronization process.
Bit 7 / BERT SYNC Enable (BSYNCE)
0 = Auto resync enabled.
1 = Auto resync disabled.
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DS26401NA2+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Octal T1/E1/J1 Framer RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS26502 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:T1/E1/J1/64KCC BITS Element
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