參數(shù)資料
型號(hào)： DS26401DK
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 30/309頁(yè)
文件大?。?/td> 0K
描述： KIT DESIGN FOR DS26401
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
設(shè)計(jì)資源： DS26401DK Gerber Files
標(biāo)準(zhǔn)包裝： 1
主要目的： 電信，調(diào)幀器
已用 IC / 零件： DS26401
已供物品： 板，子卡，CD
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DS26401 Octal T1/E1/J1 Framer
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9.12 T1 Transmit Elastic Stores Operation
The DS26401 contains dual two-frame elastic stores, one for the receive direction and one for the transmit
direction. Both elastic stores are fully independent. The transmit- and receive-side elastic stores can be
enabled/disabled independent of each other. Also, each elastic store can interface to either a 1.544MHz or
2.048/4.096/8.192/16.384MHz backplane without regard to the backplane rate of the other elastic store.
The elastic stores have two main purposes. First, they can be used for rate conversion. When the DS26401 is in the
T1 mode, the elastic stores can rate convert the T1 data stream to a 2.048MHz backplane. In E1 mode, the elastic
store can rate convert the E1 data stream to a 1.544MHz backplane. Secondly, they can be used to absorb the
differences in frequency and phase between the T1 or E1 data stream and an asynchronous (i.e., not locked)
backplane clock (which can be 1.544MHz or 2.048MHz). In this mode, the elastic stores will manage the rate
difference and perform controlled slips, deleting or repeating frames of data in order to manage the difference
between the network and the backplane.
The elastic stores can also be used to multiplex T1 or E1 data streams into higher backplane rates. This is the
Interleave Bus Option (IBO) which is discussed in Section 9.20.
Note that the receive elastic store status bits are contained in TLS1 with the associated interrupt bits located in
TIM1. These bits indicate a receive slip event, or when the e-store FIFO is in a ‘full’ or ‘empty’ condition. See the
register definition for TLS1 for additional information.
The operation of the transmit elastic store is very similar to the receive side. If the transmit side elastic store is
enabled a 1.544MHz or 2.048MHz clock can be applied to the TSYSCLK input. For higher rate system clock
applications, see the Interleave Bus Option section. Controlled slips in the transmit elastic store are reported in the
TLS1.5 bit and the direction of the slip is reported in the TLS1.6 and TLS1.7 bits.
If the user selects to apply a 2.048MHz clock to the TSYSCLK pin, then the data input at TSER will be ignored on
the channels marked by the TBCS registers. The user can supply frame or multiframe sync pulse to the TSSYNC
input. Note that the user may find it useful to program the TCHBLK output as a method to mark backplane channels
that will be ignored during T1 to E1 conversion.
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DS26401N+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Octal T1/E1/J1 Framer RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS26401NA2 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Octal T1/E1/J1 Framer RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS26401NA2+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Octal T1/E1/J1 Framer RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS26502 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:T1/E1/J1/64KCC BITS Element
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