參數(shù)資料
型號(hào): DS26503L+
廠商: Maxim Integrated Products
文件頁(yè)數(shù): 77/122頁(yè)
文件大?。?/td> 0K
描述: IC T1/E1/J1 BITS ELEMENT 64-LQFP
產(chǎn)品培訓(xùn)模塊: Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝: 160
類型: BITS 元件,多路復(fù)用器
PLL:
主要目的: T1/E1
輸入: 時(shí)鐘
輸出: 時(shí)鐘
電路數(shù): 1
比率 - 輸入:輸出: 2:2
差分 - 輸入:輸出: 無/無
頻率 - 最大: 6.312MHz
電源電壓: 3.135 V ~ 3.465 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 64-LQFP
供應(yīng)商設(shè)備封裝: 64-LQFP(10x10)
包裝: 托盤
產(chǎn)品目錄頁(yè)面: 1430 (CN2011-ZH PDF)
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DS26503 T1/E1/J1 BITS Element
Register Name:
RFDL (RFDL register bit usage when BOCC.4 = 1)
Register Description:
Receive FDL Register
Register Address:
50h
Bit #
7
6
5
4
3
2
1
0
Name
RBOC5
RBOC4
RBOC3
RBOC2
RBOC1
RBOC0
Default
0
HW
Mode
0
Bit 0: BOC Bit 0 (RBOC0)
Bit 1: BOC Bit 1 (RBOC1)
Bit 2: BOC Bit 2 (RBOC2)
Bit 3: BOC Bit 3 (RBOC3)
Bit 4: BOC Bit 4 (RBOC4)
Bit 5: BOC Bit 5 (RBOC5)
Bits 6 and 7: This bit position is unused when BOCC.4 = 1.
Register Name:
RFDLM1, RFDLM2
Register Description:
Receive FDL Match Register 1
Receive FDL Match Register 2
Register Address:
52h, 53h
Bit #
7
6
5
4
3
2
1
0
Name
RFDLM7
RFDLM6
RFDLM5
RFDLM4
RFDLM3
RFDLM2
RFDLM1
RFDLM0
Default
0
HW
Mode
0
Bit 0: Receive FDL Match Bit 0 (RFDLM0). LSB of the FDL Match Code.
Bit 1: Receive FDL Match Bit 1 (RFDLM1)
Bit 2: Receive FDL Match Bit 2 (RFDLM2)
Bit 3: Receive FDL Match Bit 3 (RFDLM3)
Bit 4: Receive FDL Match Bit 4 (RFDLM4)
Bit 5: Receive FDL Match Bit 5 (RFDLM5)
Bit 6: Receive FDL Match Bit 6 (RFDLM6)
Bit 7: Receive FDL Match Bit 7 (RFDLM7). MSB of the FDL Match Code.
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PDF描述
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