參數(shù)資料
型號： DS3184+
廠商： Maxim Integrated Products
文件頁數(shù)： 225/400頁
文件大?。?/td> 0K
描述： IC PACKET PHY W/LIU 400-CSBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 40
類型： 調(diào)幀器
應(yīng)用： 數(shù)據(jù)傳輸
安裝類型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 管件
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DS3181/DS3182/DS3183/DS3184
300
12.10.6 Receive G.832 E3 Register Map
The receive G.832 E3 uses 13 registers.
Table 12-38. Receive G.832 E3 Framer Register Map
ADDRESS
REGISTER
REGISTER DESCRIPTION
(1,3,5,7)20h
E3 G.832 Receive Control Register
(1,3,5,7)22h
E3 G.832 Receive MA Byte Control Register
(1,3,5,7)24h
E3 G.832 Receive Status Register 1
(1,3,5,7)26h
E3 G.832 Receive Status Register 2
(1,3,5,7)28h
E3 G.832 Receive Status Register Latched 1
(1,3,5,7)2Ah
E3 G.832 Receive Status Register Latched 2
(1,3,5,7)2Ch
E3 G.832 Receive Status Register Interrupt Enable 1
(1,3,5,7)2Eh
E3 G.832 Receive Status Register Interrupt Enable 2
(1,3,5,7)30h
E3 G.832 Receive MA Byte Register
(1,3,5,7)32h
E3 G.832 Receive NR and GC Byte Register
(1,3,5,7)34h
E3 G.832 Receive Framing Error Count Register
(1,3,5,7)36h
E3 G.832 Receive Parity Error Count Register
(1,3,5,7)38h
E3 G.832 Receive Remote Error Indication Count Register
(1,3,5,7)3Ah
—
Reserved
(1,3,5,7)3Ch
—
Unused
(1,3,5,7)3Eh
—
Unused
12.10.6.1 Register Bit Descriptions
Register Name:
E3G832.RCR
Register Description:
E3 G.832 Receive Control Register
Register Address:
(1,3,5,7)20h
Bit #
15
14
13
12
11
10
9
8
Name
Reserved
PEC
DLS
MDAISI
AAISD
ECC
FECC1
FECC0
Default
0
Bit #
7
6
5
4
3
2
1
0
Name
RDILE
RDILD
RDIOD
RDIAD
ROMD
LIP1
LIP0
FRSYNC
Default
0
Bit 14: Parity Error Count (PEC) – When 0, BIP-8 block errors (EM byte) are detected (no more than one per
frame). When 1, BIP-8-bit errors are detected (up to 8 per frame).
Bit 13: Receive HDLC Data Link Source (DLS) – When 0, the receive HDLC data link will be sourced from the
GC byte. When 1, the receive HDLC data link will be sourced from the NR byte.
Bit 12: Manual Downstream AIS Insertion (MDAISI) – When 0, manual downstream AIS insertion is disabled.
When 1, manual downstream AIS insertion is enabled.
Bit 11: Automatic Downstream AIS Disable (AAISD) – When 0, the presence of an LOS, OOF, or AIS condition
will cause downstream AIS to be inserted. When 1, the presence of an LOS, OOF, or AIS condition will not cause
downstream AIS to be inserted.
Bit 10: Error Count Control (ECC) – When 0, framing errors, parity errors, and REI errors will not be counted if an
OOF or AIS condition is present. Parity errors and REI errors will also not be counted during the E3 frame in which
an OOF or AIS condition is terminated, and the next E3 frame. When 1, framing errors, parity errors, and REI
errors will be counted regardless of the presence of an OOF or AIS condition.
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PDF描述
MAX4507CWN IC SIGNAL LINE PROTECTOR 18-SOIC
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LFXP20C-4F484I IC FPGA 19.7KLUTS 340I/O 484-BGA
MAX4505EUK-T IC SIGNAL LINE PROTECTOR SOT23-5
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參數(shù)描述
DS3184+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3184DK 功能描述:網(wǎng)絡(luò)開發(fā)工具 RoHS:否 制造商:Rabbit Semiconductor 產(chǎn)品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評估:RCM6600W 數(shù)據(jù)速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V
DS3184N 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3184N+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS318PIN 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Industrial Control IC
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