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參數(shù)資料
| 型號： | DS3184+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 50/400頁 |
| 文件大小： | 0K |
| 描述： | IC PACKET PHY W/LIU 400-CSBGA |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 40 |
| 類型： | 調(diào)幀器 |
| 應用： | 數(shù)據(jù)傳輸 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 400-BBGA |
| 供應商設備封裝： | 400-PBGA（27x27） |
| 包裝： | 管件 |
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DS3181/DS3182/DS3183/DS3184
143
Figure 10-26. Receive DSS Scrambler Synchronization State Diagram
Steady
State
Acquisition
Verification
8 Cells Fail Verification
32 Samples Loaded
8
C
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Pa
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If cell processing is disabled, a cell boundary is arbitrarily chosen, and the data is divided into "cells" whose size is
programmable. If HEC transfer is enabled in the receive system interface, the incoming data stream will be divided
into 53-byte "cells". If HEC transfer is disabled in the receive system interface, the data is divided into 52-byte
"cells". These cells are then passed on to bit reordering bypassing cell delineation, OCD detection, cell filtering,
header pattern comparison, HEC error monitoring, and HEC byte filtering.
Cell delineation determines the cell boundary by identifying the header bytes and the HEC byte of a cell, and
detects an out of cell delineation (OCD) condition or a change of cell delineation (COCD). Cell delineation is
performed off-line, and the data path cell boundary is only updated by cell delineation if an OCD condition is
present. Performing cell delineation off-line results in fewer cells being discarded when the cell boundary changes.
If DSS scrambling is enabled (bit synchronous mode only), only the six least significant bits (LSBs) of the HEC
(HEC[3:8]) are used for cell delineation, as the two most significant bits (MSBs) are scrambled. An OCD condition
is declared if seven consecutive cells are received with incorrect HEC bytes. An OCD condition is terminated if
“Delta” consecutive cells are received with correct HEC bytes, if cell delineation updates the data path cell
boundary, or if the PLCP framer updates the data path cell boundary (PLCP modes only). All ATM cells are
discarded during an OCD condition. A COCD is declared when Cell Delineation or the PLCP framer updates the
data path cell boundary with a cell boundary that is different from the current data path cell boundary .
Cell delineation has three states: "Hunt", "Presync", and "Sync". The "Hunt" state searches for the cell boundary.
Each time slot is checked for an HEC byte (six LSBs of the HEC byte if DSS is enabled). The cell boundary is set
once the header and HEC bytes are identified, and cell delineation transitions to the “Presync” state. The "Presync"
state verifies the cell boundary identified in the “Hunt” state. The HEC is checked in each incoming cell. If “Delta”
cells (including the "Hunt" to "Presync" transition cell) with a correct HEC are received, cell delineation transitions
to the “Sync” state. If a cell with an incorrect HEC is received, cell delineation transitions to the “Hunt” state. The
"Sync" state checks the HEC in each cell. If a cell with a correct HEC is received, cell delineation updates the data
path cell boundary if an OCD condition is present. If a cell with an incorrect HEC is received, cell delineation
transitions to the “Hunt” state. The cell delineation state diagram is shown in Figure 10-27. The cell delineation
process starts in the "Hunt" state. In octet-aligned mode, the HEC check is performed one byte at a time, so up to
53 checks may be needed to find the cell boundary. In bit synchronous mode, the HEC check is performed one bit
at a time, so up to 424 checks may be needed to find the cell boundary. HEC calculation coset polynomial addition
can be disabled. The cell delineation process can be programmed to ignore the first header byte (for DQDB
applications) when calculating the HEC. If cell processing is disabled, cell delineation will not be performed. A
“Delta” of eight is used during the DS3 clear-channel, STS-1 clear-channel, and E3 clear-channel modes. A “Delta”
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MAX4507CWN | IC SIGNAL LINE PROTECTOR 18-SOIC |
| MAX4507CAP | IC SIGNAL LINE PROTECTOR 20-SSOP |
| LFXP20C-4F484I | IC FPGA 19.7KLUTS 340I/O 484-BGA |
| MAX4505EUK-T | IC SIGNAL LINE PROTECTOR SOT23-5 |
| LFXP20E-4FN484I | IC FPGA 19.7KLUTS 484FPBGA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DS3184+ | 功能描述:網(wǎng)絡控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS3184DK | 功能描述:網(wǎng)絡開發(fā)工具 RoHS:否 制造商:Rabbit Semiconductor 產(chǎn)品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評估:RCM6600W 數(shù)據(jù)速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V |
| DS3184N | 功能描述:網(wǎng)絡控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS3184N+ | 功能描述:網(wǎng)絡控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS318PIN | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Industrial Control IC |
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