參數(shù)資料
型號(hào)： DSM2180F3V90T6
廠商： 意法半導(dǎo)體
元件分類： 數(shù)字信號(hào)處理
英文描述： DSM (Digital Signal Processor System Memory) For Analog Devices ADSP-218X Family (5V Supply)
中文描述： 帝斯曼（數(shù)字信號(hào)處理器系統(tǒng)內(nèi)存）模擬器件公司的ADSP - 218X系列（5V電源）
文件頁(yè)數(shù)： 54/63頁(yè)
文件大小： 809K
代理商： DSM2180F3V90T6
DSM2180F3
54/63
Table 32. Write Timing
Note: 1. Any input used to select an internal DSM function.
2. Assuming data is stable before active write signal.
3. Assuming write is active before data becomes valid.
4. TWHAX2 is the address hold time for DPLD inputs that are used to generate Sector Select signals for internal DSM memory.
Figure 35. Write Timing
Symbol
Parameter
Conditions
-90
Unit
Min.
Max.
t
AVWL
Address Valid to Leading Edge of WR
(Note
1
)
0
ns
t
SLWL
CS Valid to Leading Edge of WR
0
ns
t
DVWH
WR Data Setup Time
35
ns
t
WHDX
WR Data Hold Time
4
ns
t
WLWH
WR Pulse Width
35
ns
t
WHAX1
Trailing Edge of WR to Address Invalid
3
ns
t
WHAX2
Trailing Edge of WR to DPLD Address Invalid
(Note
4
)
0
ns
t
WHPV
Trailing Edge of WR to Port Output
Valid Using I/O Port Data Register
30
ns
t
DVMV
Data Valid to Port Output Valid Using Macrocell
Register Preset/Clear
(Note
3
)
55
ns
t
WLMV
WR Valid to Port Output Valid Using
Macrocell Register Preset/Clear
(Note
2
)
55
ns
tAVWL
tSLWL
tWHDX
tWHAX
tWLWH
tDVWH
ADDRESS
VALID
DATA
VALID
ADDRESS
NON-MULTIPLEXED
BUS
DATA
NON-MULTIPLEXED
BUS
CSI
WR
AI04909
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