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參數(shù)資料
| 型號： | DSP56F803E |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | 16-bit Digital Signal Controllers |
| 中文描述： | 16位數(shù)字信號控制器 |
| 文件頁數(shù)： | 37/52頁 |
| 文件大小： | 414K |
| 代理商： | DSP56F803E |
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Serial Peripheral Interface (SPI) Timing
56F803 Technical Data, Rev. 15
Freescale Semiconductor
37
Figure 3-18 SPI Master Timing (CPHA = 0)
Data Valid for outputs
Master
Slave (after enable edge)
t
DV
—
—
4.5
20.4
ns
ns
Figures
3-18
, ,
3-20
,
3-21
Data invalid
Master
Slave
t
DI
0
0
—
—
ns
ns
Figures
3-18
, ,
3-20
,
3-21
Rise time
Master
Slave
t
R
—
—
11.5
10.0
ns
ns
Figures
3-18
, ,
3-20
,
3-21
Fall time
Master
Slave
t
F
—
—
9.7
9.0
ns
ns
Figures
3-18
, ,
3-20
,
3-21
1.
Parameters listed are guaranteed by design.
Table 3-12 SPI Timing
1
Operating Conditions:
V
SS
= V
SSA
= 0 V, V
DD
= V
DDA
= 3.0–3.6V, T
A
= –40
°
to +85
°
C, C
L
≤
50pF, f
OP
= 80MHz
Characteristic
Symbol
Min
Max
Unit
See Figure
SCLK (CPOL = 0)
(Output)
SCLK (CPOL = 1)
(Output)
MISO
(Input)
MOSI
(Output)
MSB in
Bits 14–1
LSB in
Master MSB out
Bits 14–1
Master LSB out
SS
(Input)
SS is held High on master
t
C
t
R
t
F
t
F
t
DI
t
DS
t
DI
(ref)
t
DV
t
CH
t
DH
t
R
t
F
t
R
t
CL
t
CH
t
CL
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DSP56F805E | 16-bit Digital Signal Controllers |
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參數(shù)描述 |
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