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參數(shù)資料
| 型號(hào)： | EP20K200EQC240-3 |
| 廠商： | Altera |
| 文件頁(yè)數(shù)： | 86/117頁(yè) |
| 文件大小： | 0K |
| 描述： | IC APEX 20KE FPGA 200K 240-PQFP |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | APEX-20K® |
| LAB/CLB數(shù)： | 832 |
| 邏輯元件/單元數(shù)： | 8320 |
| RAM 位總計(jì)： | 106496 |
| 輸入/輸出數(shù)： | 168 |
| 門(mén)數(shù)： | 404000 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類(lèi)型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 240-BFQFP |
| 供應(yīng)商設(shè)備封裝： | 240-PQFP（32x32） |
| 其它名稱(chēng)： | 544-1095 |
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Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Figures 38 and 39 show the asynchronous and synchronous timing
waveforms, respectively, for the ESB macroparameters in Table 31.
Figure 38. ESB Asynchronous Timing Waveforms
ESB Asynchronous Write
ESB Asynchronous Read
RE
a0
d0
d3
tESBARC
a1
a2
a3
d2
d1
Rdaddress
Data-Out
WE
a0
din1
dout2
tESBDD
a1
a2
din1
din0
tESBWCCOMB
tESBWASU
tESBWAH
tESBWDH
tESBWDSU
tESBWP
din0
Data-In
Wraddress
Data-Out
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| EP20K200EQC240-3N | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 CPLD - APEX 20K 832 Macro 168 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP20K200EQI208-1 | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:FPGA |
| EP20K200EQI208-1ES | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:FPGA |
| EP20K200EQI208-1X | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:FPGA |
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