參數(shù)資料
型號： EPM2210F324A5N
廠商： ALTERA CORP
元件分類： PLD
英文描述： FLASH PLD, PBGA324
封裝： 19 X 19 MM, 1 MM PITCH, LEAD FREE, FBGA-324
文件頁數(shù)： 102/108頁
文件大?。?/td> 1342K
代理商： EPM2210F324A5N
Altera Corporation
5–23
July 2008
MAX II Device Handbook, Volume 1
DC and Switching Characteristics
Table 5–24 shows the external I/O timing parameters for EPM570
devices.
fCNT
Maximum
global clock
frequency
for 16-bit
counter
—
304.0
—
247.5
—
201.1
—
184.1
—
123.5 MHz
Note to Table 5–23
(1)
The maximum frequency is limited by the I/O standard on the clock input pin. The 16-bit counter critical delay
performs faster than this global clock input pin maximum frequency.
Table 5–23. EPM240 Global Clock External I/O Timing Parameters
(Part 2 of 2)
Symbol Parameter Condition
–3 Speed
Grade
–4 Speed
Grade
–5 Speed
Grade
–6 Speed
Grade
–7 Speed
Grade
Unit
Min
Max
Min
Max
Min
Max
Min
Max
Min
Max
Table 5–24. EPM570 Global Clock External I/O Timing Parameters
(Part 1 of 2)
Symbol Parameter
Cond-
ition
–3 Speed
Grade
–4 Speed
Grade
–5 Speed
Grade
–6 Speed
Grade
–7 Speed
Grade
Unit
Min
Max
Min
Max
Min
Max
Min
Max
Min
Max
tPD1
Worst case
pin-to-pin
delay
through 1
look-up
table (LUT)
10 pF
—
5.4
—
7.0
—
8.7
—
9.5
—
15.1
ns
tPD2
Best case
pin-to-pin
delay
through 1
LUT
10 pF
—
3.7
—
4.8
—
5.9
—
5.7
—
7.7
ns
tSU
Global
clock setup
time
—
1.2
—
1.5
—
1.9
—
2.6
—
4.5
—
ns
相關PDF資料
PDF描述
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EPM2210GF256A5N FLASH PLD, PBGA256
EPM2210GF324A3N FLASH PLD, PBGA324
EPM2210GF324A4N FLASH PLD, PBGA324
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