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參數(shù)資料
| 型號(hào)： | EVAL-AD7765EDZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 16/33頁 |
| 文件大?。?/td> | 0K |
| 描述： | BOARD EVAL AD7765 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| ADC 的數(shù)量： | 1 |
| 位數(shù)： | 24 |
| 采樣率（每秒）： | 156k |
| 數(shù)據(jù)接口： | 串行，SPI? |
| 輸入范圍： | ±3.2768 V |
| 在以下條件下的電源（標(biāo)準(zhǔn)）： | 300mW @ 156kSPS |
| 工作溫度： | -40°C ~ 85°C |
| 已用 IC / 零件： | AD7765 |
| 已供物品： | 板 |
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AD7765
Rev. A | Page 22 of 32
POWER MODES
Low Power Mode
During power-up, the AD7765 defaults to operate in normal
power mode. There is no register write required.
The AD7765 also offers low power mode. To operate the device
in low power mode, the user sets the LPWR bit in the control
register to logic high (see Figure 37). Operating the AD7765 in
low power mode has no impact on the output data rate or
available bandwidth.
SCO (O)
CONTROL REGISTER
ADDRESS 0x0001
LOW POWER MODE
DATA 0x0004
FSI (I)
SDI (I)
32 ×
tSCO
06519-
017
Figure 37. Write Scheme for Low Power Mode
RESET/
The AD7765 features a
PWRDWN Mode
RESET/PWRDWN pin. Holding the
input to this pin logic low places the AD7765 in power-down
mode. All internal circuitry is reset. Apply a RESET pulse to the
AD7765 after initial power-up of the device.
The AD7765 RESET pin is polled by the rising edge of MCLK.
The AD7765 device goes into reset when an MCLK rising
senses the RESET input signal to be logic low. AD7765 comes
out of RESET on the first MCLK rising edge that senses RESET
to be logic high.
The best practice is to ensure that all transitions of RESET
occur synchronously with the falling edge of MCLK; otherwise,
adhere to the timing requirements shown in Figure 38.
RESET should be kept logic low for a minimum of 1 MCLK
period for a valid reset to occur.
In cases where multiple AD7765 devices are being synchronized
using the SYNC pulse and in the case of daisy chaining multiple
AD7765 devices, a common RESET pulse must be provided in
addition to the common
06519-
304
MCLK
tR MIN
1 ×
tMCLK
tR HOLD
tR SETUP
RESET
SYNC and MCLK signals.
Figure 38. RESET
DECIMATION RATE PIN
Timing Synchronous to MCLK
The decimation rate of the AD7765 is selected using the
DEC_RATE pin. Table 11 shows the voltage input settings
required for each of the three decimation rates.
Table 11. DEC_RATE Pin Settings
Decimate
DEC_RATE Pin
Maximum Output Data Rate
128×
DVDD
156.25 kHz
256×
GND
78.125 kHz
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PCMC063T-1R5MN | COIL 1.50UH POWER CHOKE 20% SMD |
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| EBM25DRSH | CONN EDGECARD 50POS DIP .156 SLD |
| 0982660124 | CBL 12POS 0.5MM JMPR TYPE D 4" |
| EBA22DTKN-S288 | CONN EDGECARD 44POS .125 EXTEND |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| EVAL-AD7766-2EDZ | 功能描述:BOARD EVAL AD7766-2 32KSPS 114DB RoHS:是 類別:編程器，開發(fā)系統(tǒng) >> 評(píng)估板 - 模數(shù)轉(zhuǎn)換器 (ADC) 系列:- 產(chǎn)品培訓(xùn)模塊:Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1 系列:- ADC 的數(shù)量:1 位數(shù):12 采樣率（每秒）:94.4k 數(shù)據(jù)接口:USB 輸入范圍:±VREF/2 在以下條件下的電源（標(biāo)準(zhǔn)）:- 工作溫度:-40°C ~ 85°C 已用 IC / 零件:MAX11645 已供物品:板，軟件 |
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| EVAL-AD7767-1EDZ | 功能描述:BOARD EVAL AD7767-1 64KSPS 111DB RoHS:是 類別:編程器，開發(fā)系統(tǒng) >> 評(píng)估板 - 模數(shù)轉(zhuǎn)換器 (ADC) 系列:- 產(chǎn)品培訓(xùn)模塊:Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1 系列:- ADC 的數(shù)量:1 位數(shù):12 采樣率（每秒）:94.4k 數(shù)據(jù)接口:USB 輸入范圍:±VREF/2 在以下條件下的電源（標(biāo)準(zhǔn)）:- 工作溫度:-40°C ~ 85°C 已用 IC / 零件:MAX11645 已供物品:板，軟件 |
| EVAL-AD7767-2EDZ | 功能描述:BOARD EVALUATION FOR AD7767 RoHS:是 類別:編程器，開發(fā)系統(tǒng) >> 評(píng)估板 - 模數(shù)轉(zhuǎn)換器 (ADC) 系列:- 產(chǎn)品培訓(xùn)模塊:Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1 系列:- ADC 的數(shù)量:1 位數(shù):12 采樣率（每秒）:94.4k 數(shù)據(jù)接口:USB 輸入范圍:±VREF/2 在以下條件下的電源（標(biāo)準(zhǔn)）:- 工作溫度:-40°C ~ 85°C 已用 IC / 零件:MAX11645 已供物品:板，軟件 |
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