參數(shù)資料
型號(hào)： EVAL-ADAV803EBZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 52/60頁(yè)
文件大小： 0K
描述： BOARD EVALUATION FOR ADAV803
標(biāo)準(zhǔn)包裝： 1
主要目的： 接口，模擬前端（AFE）
已用 IC / 零件： ADAV803
已供物品： 板
相關(guān)產(chǎn)品： ADAV803ASTZ-ND - IC CODEC AUDIO R-DVD 3.3V 64LQFP
ADAV803ASTZ-REEL-ND - IC CODEC AUDIO R-DVD 3.3V 64LQFP
ADAV803
Rev. A | Page 56 of 60
PLL Clock Source Register—Address 1111000 (0x78)
Table 136. PLL Clock Source Register Bit Map
7
6
5
4
3
2
1
0
PLL2_Source
PLL1_Source
Reserved
Table 137. PLL Clock Source Register Bit Descriptions
Bit Name
Description
PLL2_Source
Selects the clock source for PLL2.
0 = XIN.
1 = MCLKI.
PLL1_Source
Selects the clock source for PLL1.
0 = XIN.
1 = MCLKI
PLL Output Enable—Address 1111010 (0x7A)
Table 138. PLL Output Enable Register Bit Map
7
6
5
4
3
2
1
0
Reserved
DIRINPD
DIRIN_PIN
Reserved
SYSCLK1
SYSCLK2
SYSCLK3
Table 139. PLL Output Enable Register Bit Descriptions
Bit Name
Description
DIRINPD
This bit powers down the S/PDIF receiver.
0 = Normal.
1 = Power-down.
DIRIN_PIN
This bit determines the input levels of the DIRIN pin.
0 = DIRIN accepts input signals down to 200 mV according to AES3 requirements.
1 = DIRIN accepts input signals as defined in the Specifications section.
SYSCLK1
Enables the SYSCLK1 output.
0 = Enabled.
1 = Disabled.
SYSCLK2
Enables the SYSCLK2 output.
0 = Enabled.
1 = Disabled.
SYSCLK3
Enables the SYSCLK3 output.
0 = Enabled.
1 = Disabled.
相關(guān)PDF資料
PDF描述
EVAL-ADAV801EBZ BOARD EVALUATION FOR ADAV801
H1WXH-2636M IDC CABLE - HPL26H/AE26M/X
VE-211-EX CONVERTER MOD DC/DC 12V 75W
EVAL-ADE5169EBZ-2 BOARD EVALUATION FOR AD5169
VE-J1M-EX CONVERTER MINIMOD DC/DC 10V 75W
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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EVAL-ADCMP553BRM 制造商:Analog Devices 功能描述:EVALUATION BOARD-HIGH SPEED COMPARATOR - Bulk
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