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參數(shù)資料
| 型號： | HD6433308 |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | Hitachi Single-Chip MicroComputer |
| 中文描述： | 日立單片機(jī) |
| 文件頁數(shù)： | 200/349頁 |
| 文件大?。?/td> | 1474K |
| 代理商： | HD6433308 |
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9.2.7 Serial Status Register (SSR) – H’FFDC
* Software can write a “0” to clear the flags, but cannot write a “1” in these bits.
The SSR is an 8-bit register that indicates transmit and receive status. It is initialized to H’87 at a
reset and in the standby modes.
Bit 7 – Transmit Data Register Empty (TDRE):
This bit indicates when the TDR contents have
been transferred to the TSR and the next character can safely be written in the TDR.
Bit 6 – Receive Data Register Full (RDRF):
This bit indicates when one character has been
received and transferred to the RDR.
Bit
7
6
5
4
3
2
—
1
—
1
—
1
—
0
—
1
—
TDRE
1
R/(W)*
RDRF
0
R/(W)*
ORER
0
R/(W)*
FER
0
R/(W)*
PER
0
R/(W)*
Initial value
Read/Write
Bit 7
TDRE
0
Description
To clear TDRE, the CPU must read TDRE after it has been set to "1," then write a “0”
in this bit.
This bit is set to 1 at the following times:
(1)
When TDR contents are transferred to the TSR.
(2)
When the TE bit in the SCR is cleared to "0."
1
(Initial value)
Bit 6
RDRF
0
Description
To clear RDRF, the CPU must read RDRF after
it has been set to "1," then write a “0” in this bit.
This bit is set to 1 when one character is received without error and
transferred from the RSR to the RDR.
(Initial value)
1
187
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PDF描述 |
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