參數(shù)資料
型號(hào)： ICS84021AYLFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 1/19頁
文件大?。?/td> 0K
描述： IC SYNTHESIZER HIGH FREQ 32-LQFP
標(biāo)準(zhǔn)包裝： 1,000
系列： HiPerClockS™
類型： 頻率合成器
PLL： 帶旁路
輸入： LVCMOS，LVTTL，晶體
輸出： LVCMOS，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 無/無
頻率 - 最大： 260MHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 32-LQFP
供應(yīng)商設(shè)備封裝： 32-TQFP（7x7）
包裝： 帶卷 (TR)
其它名稱： 84021AYLFT
DATA SHEET
ICS84021BY REVISION E AUGUST 18, 2011
1
2011 Integrated Device Technology, Inc.
260MHz, Crystal-to-LVCMOS/LVTTL
Frequency Synthesizer
ICS84021
General Description
The ICS84021 is a general purpose, Crystal-to-LVCMOS/LVTTL
High Frequency Synthesizer. The ICS84021 has a selectable
TEST_CLK or crystal input. The VCO operates at a frequency range
of 620MHz to 780MHz. The VCO frequency is programmed in steps
equal to the value of the input reference or crystal frequency. The
VCO and output frequency can be programmed using the serial or
parallel interface to the configuration logic.
Features
Two LVCMOS/LVTTL outputs
Selectable crystal oscillator interface or LVCMOS/LVTTL
TEST_CLK
Output frequency range: 103.3MHz to 260MHz
Crystal input frequency range: 14MHz to 40MHz
VCO range: 620MHz to 780MHz
Parallel or serial interface for programming counter and output
dividers
RMS period jitter: 14.7ps (typical), (N ÷ 4, V
DDO = 3.3V±5%)
RMS phase jitter at 155.52MHz, using a 38.88MHz crystal (12kHz
to 20MHz): 2.61ps (typical)
Offset
Noise Power
100Hz.................-87.9 dBc/Hz
1kHz ...................-115.8 dBc/Hz
10kHz .................-124.2 dBc/Hz
100kHz ...............-127.7 dBc/Hz
Full 3.3V or mixed 3.3V core/2.5V or 1.8V output supply voltage
0°C to 70°C ambient operating temperature
Industrial temperature information available upon request
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
9
10 11 12 13 14 15 16
32 31 30
29 28
27 26 25
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
M5
M6
M7
M8
N0
N1
nc
GND
XTAL_OUT
TEST_CLK
XTAL_SEL
VDDA
S_LOAD
S_DATA
S_CLOCK
MR
TEST
V
DD
OE1
OE0
V
DDO
Q1
Q0
GND
M3
M2
M1
M0
VCO_SEL
nP_LOAD
XTAL_IN
M4
ICS84021
32 Lead LQFP
7mm x 7mm x 1.4mm package body
Y Package
Top View
Block Diagram
Pin Assignment
Phase Detector
VCO
PLL
÷M
N
÷3
÷4
÷5
÷6
Configuration Interface Logic
0
1
0
1
OSC
VCO_SEL
OE1
XTAL_SEL
XTAL_IN
MR
S_LOAD
S_DATA
S_CLOCK
nP_LOAD
M[0:8]
N[0:1]
XTAL_OUT
TEST_CLK
TEST
Q0
Q1
Pullup
M5 Pullup; M[0:4, 6:8] Pulldown
Pullup
Pulldown
OE0
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PDF描述
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