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參數(shù)資料
| 型號： | ICS844S42BKILFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 1/27頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SYNTHESIZER RF FREQ 56-VFQFPN |
| 標準包裝： | 1,000 |
| 系列： | HiPerClockS™ |
| 類型： | 頻率合成器 |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 2.592GHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 56-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 56-VFQFP-EP（8x8） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 844S42BKILFT |
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DATA SHEET
ICS844S42BKI REVISION A FEBRUARY 21, 2012
1
2012 Integrated Device Technology, Inc.
Dual Output RF Frequency Synthesizer
ICS844S42I
General Description
The ICS844S42I is a 3.3V compatible, PLL based clock synthesizer
targeted for clock generation in high-performance instrumentation,
networking and computing applications. Using either the serial (I2C)
or parallel programming interface, the ICS844S42I enables the
generation of clock frequencies in the range of 81MHz to 2592MHz.
The internal crystal oscillator uses the external quartz crystal as the
basis of its frequency reference. Alternatively, a LVCMOS
compatible clock signal can be used as PLL reference signal. The
devices uses an integer-N synthesizer architecture and is optimized
for low-jitter generation. The VCO within the PLL operates over a
range of 1296MHz to 2592MHz. Its output is scaled by a divider that
is configured by either the I2C or parallel interfaces. The crystal
oscillator frequency fXTAL, the PLL pre-divider P, the
feedback-divider M and the PLL post-divider N determine the output
frequency. The feedback path of the PLL is internal.
The PLL post-dividers NA and NB are configured through either the
I2C or the parallel interfaces, each can provide one of seven division
ratios (1, 2, 3, 4, 6, 8, 16). This divider extends the performance of
the part while providing a typical 50% duty cycle. The high-frequency
outputs QA and QB are differential and are capable of driving a pair
of transmission lines. The positive supply voltage for the internal PLL
is separated from the power supply for the core logic and output
drivers to minimize noise induced jitter. The serial interface is I2C
compatible and provides read and write access to the internal PLL
configuration registers. The lock state of the PLL is indicated by the
LVCMOS-compatible LOCK_DT output. The ICS844S42I is
packaged in a 8mm x 8mm 56-lead VFQFN package.
Features
Programmable frequency synthesis optimized for instrumentation,
networking and computing applications
81MHz to 2592MHz synthesized clock output signal
Two differential, universal LVDS or LVPECL compatible
high-frequency outputs
Output frequency programmable through 2-wire I2C bus or
parallel interface
On-chip crystal oscillator for reference frequency generation
Alternative LVCMOS/LVTTL compatible reference clock input
Clock stop and output enable functionality
PLL lock indicator output (LVCMOS/LVTTL)
LVCMOS/LVTTL compatible control inputs
Fully integrated PLL
SiGe Technology
Full 3.3V supply voltage
-40°C to 85°C ambient operating temperature
Available in a lead-free (RoHS 6) compliant package
Pin Assignment
15 16 17 18 19 20 21 22 23 24 25 26 27 28
1
2
3
4
5
6
7
8
9
10
11
12
13
14
36
37
38
39
40
41
42
35
34
33
32
31
30
29
GND
nc
nBYPASS
nc
VDD
REF_CLK
GND
VDD
REF_SEL
XTAL_IN
XTAL_OUT
nMR
LOCK_DT
LEV_SEL
nc
VDDOA
QA
nQA
GND
nc
GND
QB
nQB
VDDOB
V
DD
GND
P
NA0
NA1
NA2
NB0
NB1
NB2
SDA
SCL
nPLOAD
V
DD
48
49
50
51
52
53
54
55
56
47 46 45 44 43
nc
ADR1
M0
M1
M2
M3
M4
M5
M6
M7
M8
M9
ADR0
V
DDA
ICS844S42I
56-Lead VFQFN
8mm x 8mm x 0.925mm
package body
K Package
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