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參數(shù)資料
| 型號： | ICS844S42BKILFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 15/27頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SYNTHESIZER RF FREQ 56-VFQFPN |
| 標準包裝： | 1,000 |
| 系列： | HiPerClockS™ |
| 類型： | 頻率合成器 |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 2.592GHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 56-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 56-VFQFP-EP（8x8） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 844S42BKILFT |
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ICS844S42BKI REVISION A FEBRUARY 21, 2012
22
2012 Integrated Device Technology, Inc.
ICS844S42I Data Sheet
DUAL OUTPUT RF FREQUENCY SYNTHESIZER
3. Calculations and Equations.
The purpose of this section is to calculate the power dissipation for the LVPECL output pairs.
LVPECL output driver circuit and termination are shown in Figure 8.
Figure 8. LVPECL Driver Circuit and Termination
To calculate worst case power dissipation into the load, use the following equations which assume a 50 load, and a termination voltage of
VDDO – 2V.
For logic high, VOUT = VOH_MAX = VDDO_MAX – 0.8V
(VDDO_MAX – VOH_MAX) = 0.8V
For logic low, VOUT = VOL_MAX = VDDO_MAX – 1.4V
(VDDO_MAX – VOL_MAX) = 1.4V
Pd_H is power dissipation when the output drives high.
Pd_L is the power dissipation when the output drives low.
Pd_H = [(VOH_MAX– (VDDO_MAX – 2V))/RL] * (VDDO_MAX – VOH_MAX) = [(2V – (VDDO_MAX – VOH_MAX))/RL] * (VDDO_MAX– VOH_MAX) =
[(2V – 0.8V)/50
] * 0.8V = 19.2mW
Pd_L = [(VOL_MAX – (VDDO_MAX – 2V))/RL] * (VDDO_MAX – VOL_MAX) = [(2V – (VDDO_MAX – VOL_MAX))/RL] * (VDDO_MAX – VOL_MAX) =
[(2V – 1.4V)/50
] * 1.4V = 16.8mW
Total Power Dissipation per output pair = Pd_H + Pd_L = 36mW
V
OUT
V
DDO
V
DDO - 2V
Q1
RL
50
Ω
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PDF描述 |
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參數(shù)描述 |
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