參數(shù)資料
型號(hào)： IDT77105L25TFI
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 數(shù)字傳輸電路
英文描述： PHY (TC-PMD) for 25.6 Mbps ATM Networks
中文描述： ATM NETWORK INTERFACE, PQFP64
封裝： 10 X 10 MM, STQFP-64
文件頁(yè)數(shù)： 19/24頁(yè)
文件大小： 335K
代理商： IDT77105L25TFI
19 of 24
September 11, 2000
IDT77105
UTOPIA Bus Timing Parameters
Figure 17 UTOPIA Receive
TxOSC and Reset Timing
Symbol
Parameter
Min.
Max.
Unit
t1
RxEnb set up time to RxCLK
10
—
ns
t2
RxEnb hold time from RxCLK
2
—
ns
t3
tPD from RxCLK to RxSOC, RxData, and RxRef
3
10
ns
t4
RxEmpty delay from RxCLK
1
20
ns
t5
TxData[7:0], TxParity setup time to TxCLK
10
—
ns
t6
TxData[7:0], TxParity hold time from TxCLK
2
—
ns
t7
TxSOC, TxEnb setup time to TxCLK
10
—
ns
t8
TxSOC, TxEnb hold time from TxCLK
2
—
ns
t9
TxFull delay from TxCLK
1
20
ns
t10
TxRef pulse width
TxCLK Period +5ns
—
ns
t11
RxCLK period
30
400
ns
t12
RxCLK duty cycle (T of t11)
40
60
ns
t13
TxCLK period
30
400
ns
t14
TxCLK duty cycle (% of t13)
40
60
ns
t15
RxCLK to RxData [7:0], RxParity, and RxSOC low impedance
2
12
ns
Symbol
Parameter
Min.
Typ.
Max.
Unit
Tcyc
TxOSC frequency (25.6 Mbps)
31.5
32
32.5
MHz
Tch
TxOSC high duty cycle (% of Tcyc)
40
50
50
%
Tcl
TxOSC low duty cycle (% of Tcyc))
40
50
50
%
Trpw
1
1.
Trpw must meet both minimum limits.
Minimum Resetpulse width
2* TxCLK period
—
2* RxCLK period
—
RxCLK
RxSOC
RxEmpty/RxClav
RxEnb
RxData [7:0],
RxParity
3445 drw 20
Octet 1
Octet 2
Octet 49
Oct
t
1
t
4
t
2
RxRef
t15
t
3
t11
t12
Hi-Z
Hi-Z
Octet 0
相關(guān)PDF資料
PDF描述
IDT77105 PHY (TC-PMD) for 25.6 Mbps ATM Networks
IDT77155L155 PHY (TC-PMD) USER NETWORK INTERFACE FOR 155 MBPS ATM NETWORK APPLICATIONS
IDT77155 PHY (TC-PMD) USER NETWORK INTERFACE FOR 155 MBPS ATM NETWORK APPLICATIONS
IDT77155L155PX PHY (TC-PMD) USER NETWORK INTERFACE FOR 155 MBPS ATM NETWORK APPLICATIONS
IDT77301 UTOPIAFIFO 1 TO 4 (128 x 9 x 4) DEMULTIPLEXER-FIFO
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參數(shù)描述
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