參數(shù)資料
型號(hào): IDT82V2088BB
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 數(shù)字傳輸電路
英文描述: OCTAL CHANNEL T1/E1/J1 LONG HAUL/ SHORT HAUL LINE INTERFACE UNIT
中文描述: DATACOM, PCM TRANSCEIVER, PBGA208
封裝: PLASTIC, BGA-208
文件頁數(shù): 101/375頁
文件大?。?/td> 2430K
代理商: IDT82V2088BB
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IDT82P2281
SINGLE T1/E1/J1 LONG HAUL / SHORT HAUL TRANSCEIVER
90
October 7, 2003
3.27.2
LOOPBACK
System Loopback, Payload Loopback, Local Digital Loopback 1 &
2, Remote Loopback and Analog Loopback are all supported in the
IDT82P2281. Their routes are shown in the Functional Block Diagram.
3.27.2.1
System Loopback
The System Loopback can only be implemented when the Receive
System Interface and the Transmit System Interface are in different
Non-multiplexed operating modes (one in Clock Master mode and the
other in Clock Slave mode). However, in T1/J1 mode, when either the
receive path or the transmit path is in T1/J1 mode E1 rate, the System
Loopback is not supported.
Distinguished by the loopback direction, the System Loopback can
be divided into System Remote Loopback and System Local Loopback.
When the data and signaling bits from the transmit path are looped to
the receive path, it is System Remote Loopback. When the data and sig-
naling bits from the receive path are looped to the transmit path, it is
System Local Loopback.
3.27.2.1.1
Enabled by the SRLP bit, the System Remote Loopback is imple-
mented. The data and signaling bits to be transmitted on the TSD and
TSIG pins are internally looped to the RSD and RSIG pins. When the
receive path is in Receive Clock Master mode and the transmit path is in
Transmit Clock Slave mode, the clock signal and the framing pulse from
the system side on the TSCK and TSFS pins are looped to the RSCK
and RSFS pins respectively. When the transmit path is in Transmit Clock
Master mode and the receive path is in Receive Clock Slave mode, the
clock signal and the framing pulse from the system side on the RSCK
and RSFS pins are looped to the TSCK and TSFS pins respectively.
In System Remote Loopback mode, the data stream to be transmit-
ted is still output to the line side, while the data stream received from the
line side is replaced by the System Remote Loopback data.
System Remote Loopback
3.27.2.1.2
Enabled by the SLLP bit, the System Local Loopback is imple-
mented. The received data and signaling bits to be output on the RSD
and RSIG pins are internally looped to the TSD and TSIG pins. When
the receive path is in Receive Clock Master mode and the transmit path
is in Transmit Clock Slave mode, the recovered clock signal and framing
pulse on the RSCK and RSFS pins are looped to the TSCK and TSFS
pins respectively. When the transmit path is in Transmit Clock Master
mode and the receive path is in Receive Clock Slave mode, the TSCK
and TSFS pins are looped to the RSCK and RSFS pins respectively.
In System Local Loopback mode, the data stream received from
the line side is still output to the system through the RSD and RSIG pins,
while the data stream to be transmitted through the TSD and TSIG pins
are replaced by the System Local Loopback data.
System Local Loopback
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IDT82V2088DR 功能描述:IC LIU T1/J1/E1 8CH 208-TQFP RoHS:否 類別:集成電路 (IC) >> 接口 - 驅(qū)動(dòng)器,接收器,收發(fā)器 系列:- 標(biāo)準(zhǔn)包裝:250 系列:- 類型:收發(fā)器 驅(qū)動(dòng)器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-TSSOP(0.173",4.40mm 寬) 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:帶卷 (TR)
IDT82V2088DRG 功能描述:IC LIU T1/J1/E1 8CH 208-TQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 驅(qū)動(dòng)器,接收器,收發(fā)器 系列:- 標(biāo)準(zhǔn)包裝:250 系列:- 類型:收發(fā)器 驅(qū)動(dòng)器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-TSSOP(0.173",4.40mm 寬) 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:帶卷 (TR)
IDT82V2108 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:T1 / E1 / J1 OCTAL FRAMER
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