參數(shù)資料
型號： IDT82V3288BC
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 通信及網(wǎng)絡(luò)
英文描述： WAN PLL
中文描述： SPECIALTY TELECOM CIRCUIT, PBGA208
封裝： PLASTIC, CABGA-208
文件頁數(shù)： 146/170頁
文件大?。?/td> 1053K
代理商： IDT82V3288BC
IDT82V3288
WAN PLL
Programming Information
146
June 22, 2006
OUT9_FREQ_CNFG - Output Clock 9 Frequency Configuration & Output Clock 1 ~ 5 Invert Configuration
Address:73H
Type: Read / Write
Default Value: 01000000
Bit
Name
Description
7
OUT9_PATH_SEL
These bits select an input to OUT9.
0: The output of T4 DPLL 16E1/16T1 path. (default)
1: The output of T0 DPLL 16E1/16T1 path.
Refer to the description of the T4_INPUT_FAIL bit (b5, 73H).
This bit, together with the OUT9_EN bit (b6, 73H), determines whether clock is enabled to output on OUT9.
6
OUT9_EN
5
T4_INPUT_FAIL
4
OUT5_INV
This bit determines whether the output on OUT5 is inverted.
0: Not inverted. (default)
1: Inverted.
This bit determines whether the output on OUT4 is inverted.
0: Not inverted. (default)
1: Inverted.
This bit determines whether the output on OUT3 is inverted.
0: Not inverted. (default)
1: Inverted.
This bit determines whether the output on OUT2 is inverted.
0: Not inverted. (default)
1: Inverted.
This bit determines whether the output on OUT1 is inverted.
0: Not inverted. (default)
1: Inverted.
3
OUT4_INV
2
OUT3_INV
1
OUT2_INV
0
OUT1_INV
7
6
5
4
3
2
1
0
OUT9_PATH_S
EL
OUT9_EN
T4_INPUT_FAI
L
OUT5_INV
OUT4_INV
OUT3_INV
OUT2_INV
OUT1_INV
OUT9_EN
T4_INPUT_FAIL
Output on OUT9
0
don’t-care
0
Output is disabled (output low).
Output is enabled. (default)
1
1
Output is enabled when the T4 selected input clock does not fail.
Output is disabled (output low) when the T4 selected input clock fails.
(Whether the T4 selected input clock is switched or not, as long as the T4 selected
input clock does not change to be invalid, the T4 selected input clock does not fail).
相關(guān)PDF資料
PDF描述
IDT82V3288BCG WAN PLL
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參數(shù)描述
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