參數(shù)資料
型號： IDT82V3288BCG
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 通信及網(wǎng)絡
英文描述： WAN PLL
中文描述： SPECIALTY TELECOM CIRCUIT, PBGA208
封裝： GREEN, PLASTIC, CABGA-208
文件頁數(shù)： 69/170頁
文件大?。?/td> 1053K
代理商： IDT82V3288BCG
IDT82V3288
WAN PLL
Programming Information
69
June 22, 2006
NOMINAL_FREQ[23:16]_CNFG - Crystal Oscillator Frequency Offset Calibration Configuration 3
T4_T0_REG_SEL_CNFG - T0 / T4 Registers Selection Configuration
Address: 06H
Type: Read / Write
Default Value: 00000000
Bit
Name
Description
7 - 0
NOMINAL_FREQ_VALUE[23:16]
The NOMINAL_FREQ_VALUE[23:0] bits represent a 2’s complement signed integer. If the value is multiplied by
0.0000884, the calibration value for the master clock in ppm will be gotten.
For example, the frequency offset on OSCI is +3 ppm. Though -3 ppm should be compensated, the calibration value is
calculated as +3 ppm:
3 ÷ 0.0000884 = 33937 (Dec.) = 8490 (Hex);
So ‘008490’ should be written into these bits.
The calibration range is within ±741 ppm.
Address: 07H
Type: Read / Write
Default Value: XXX0XXXX
Bit
Name
Description
7 - 5
-
Reserved.
A part of the registers are shared by T0 and T4 paths. These registers are addressed 26H ~ 2CH, 4EH, 4FH, 5AH, 5BH, 62H ~
64H, 68H and 69H. This bit determines whether the register configuration is available for T0 or T4 path.
0: T0 path (default).
1: T4 path.
Reserved.
4
T4_T0_SEL
3 - 0
-
7
6
5
4
3
2
1
0
NOMINAL_FRE
Q_VALUE23
NOMINAL_FRE
Q_VALUE22
NOMINAL_FRE
Q_VALUE21
NOMINAL_FRE
Q_VALUE20
NOMINAL_FRE
Q_VALUE19
NOMINAL_FRE
Q_VALUE18
NOMINAL_FRE
Q_VALUE17
NOMINAL_FRE
Q_VALUE16
7
6
5
4
3
2
1
0
-
-
-
T4_T0_SEL
-
-
-
-
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