參數(shù)資料
型號： IDTCSPU877ABV8
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時鐘及定時
英文描述： 877 SERIES, PLL BASED CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PBGA52
封裝： VFBGA-52
文件頁數(shù)： 8/13頁
文件大?。?/td> 115K
代理商： IDTCSPU877ABV8
4
COMMERCIALTEMPERATURERANGE
IDTCSPU877A
1.8V PLL DIFFERENTIAL 1:10 SDRAM CLOCK DRIVER
PIN DESCRIPTION (VFBGA)
Pin Name
Pin Number
Description
AGND
G1
Ground for 1.8V analog supply
AVDD
H1
1.8V analog supply
CLK, CLK
E1, F1
Differential clock input with a 10K
Ωto100KΩpulldownresistor
FBIN, FBIN
E6, F6
Feedbackdifferentialclockinput
FBOUT, FBOUT
G6, H6
Feedbackdifferentialclockoutput
GND
B2 - B5, C2, C5, H2, H5, J2 - J5
Ground
VDDQ
D2 - D4, E2, E5, F2, G2 - G5
1.8V supply
OE
F5
OutputEnable
OS
D5
Output Select (tied to GND or VDDQ)
Y[0:9]
A3, A4, B1, B6, C1, C6, K1, K2, K5, K6
Bufferedoutputofinputclock,CLK
Y[0:9]
A1, A2, A5, A6, D1, D6, J1, J6, K3, K4
Bufferedoutputofinputclock,CLK
NB
No Ball
PIN DESCRIPTION (VFQFPN)
Pin Name
Pin Number
Description
AGND
7
Ground for 1.8V analog supply
AVDD
8
1.8V analog supply
CLK, CLK
4, 5
Differential clock input with a 10K
Ωto100KΩpulldownresistor
FBIN, FBIN
26, 27
Feedbackdifferentialclockinput
FBOUT, FBOUT
24, 25
Feedbackdifferentialclockoutput
GND
10
Ground
VDDQ
1, 6, 9, 15, 20, 23, 28, 31, 36
1.8V supply
OE
22
OutputEnable
OS
21
Output Select (tied to GND or VDDQ)
Y[0:9]
3, 11, 14, 16, 19, 29, 33, 34, 38, 39
Bufferedoutputofinputclock,CLK
Y[0:9]
2, 12, 13, 17, 18, 30, 32, 35, 37, 40
Bufferedoutputofinputclock,CLK
NB
No Ball
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PDF描述
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參數(shù)描述
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