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參數(shù)資料
| 型號： | IDTCSPU877ABV8 |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時(shí)鐘及定時(shí) |
| 英文描述： | 877 SERIES, PLL BASED CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PBGA52 |
| 封裝： | VFBGA-52 |
| 文件頁數(shù)： | 9/13頁 |
| 文件大?。?/td> | 115K |
| 代理商： | IDTCSPU877ABV8 |
5
IDTCSPU877A
1.8V PLL DIFFERENTIAL 1:10 SDRAM CLOCK DRIVER
COMMERCIALTEMPERATURERANGE
NOTES:
1. H = HIGH Voltage Level
L = LOW Voltage Level
X = Don't Care
2. L(z) means the outputs are disabled to a LOW state, meeting the IODL limit in DC Electrical Characteristics table.
3. The device will enter a low power-down mode when CLK and CLK are both at logic LOW.
FUNCTION TABLE(1,2)
INPUTS
OUTPUTS
AVDD
OE
OS
CLK
Y
FBOUT
PLL
GND
H
X
LH
L
H
LH
OFF
GND
H
X
HL
H
L
HL
OFF
GND
L
H
L
H
L(z)
L
H
OFF
L(z)
GND
L
H
L
Y7
H
L
OFF
Active
1.8V(nom)
L
H
L
H
L(z)
L
H
ON
L(z)
1.8V(nom)
L
H
L
Y7
HL
ON
Active
1.8V(nom)
H
X
L
H
L
H
L
H
ON
1.8V(nom)
H
X
H
L
H
L
H
L
ON
1.8V(nom)
X
L
(3)
L
(3)
L(z)
OFF
X
H
Reserved
DC ELECTRICAL CHARACTERISTICS OVER OPERATING RANGE
Following Conditions Apply Unless Otherwise Specified:
Commercial: TA = 0°C to +70°C
Symbol
Parameter
Conditions
Min.
Typ.
Max.
Unit
VIK
InputClampVoltage(AllInputs)
VDDQ = 1.7V, II = -18mA
– 1.2
V
VIL(2)
Input LOW Voltage (OE, OS, CLK, CLK)
0.35VDDQ
V
VIH(2)
Input HIGH Voltage (OE, OS, CLK, CLK)
0.65VDDQ
VIN(1)
InputSignalVoltage
-0.3
VDDQ + 0.3
V
VID(DC)(2)
DCInputDifferentialVoltage
0.3
VDDQ + 0.4
V
VOD(3)
OutputDifferentialVoltage
AVDD/VDDQ = 1.7V
0.5
V
VOH
Output HIGH Voltage
IOH = -100
μA, VDDQ = 1.7V to 1.9V
VDDQ - 0.2
V
IOH = -9mA, VDDQ = 1.7V
1.1
VOL
OutputLOWVoltage
IOL = 100
μA, VDDQ = 1.7V to 1.9V
0.1
V
IOL = 9mA, VDDQ = 1.7V
0.6
IODL
OutputDisabledLOWCurrent
OE = L, VODL = 100mV, AVDD/VDDQ = 1.7V
100
μA
IIN
InputCurrent CLK, CLK
AVDD/VDDQ = Max., VI = 0V to VDDQ
±250
μA
OE, OS, FBIN, FBIN
±10
IDDLD
Static Supply Current (IDDQ and IADD)AVDD/VDDQ = Max., CLK and CLK = GND
500
μA
IDD
Dynamic Power Supply Current
AVDD/VDDQ = Max., CLK = 270MHz
300
mA
(IDDQ andIADD)(4,5)
NOTES:
1. VIN specifies the allowable DC excursion of each different output.
2. VID is the magnitude of the difference between the input level on CLK and the input level on CLK. The CLK and CLK VIH and VIL limits are used to define the DC LOW and HIGH
levels for the power down mode.
3. VOD is the magnitude of the difference between the true output level and the complementary level.
4. All Outputs are left open (unconnected to PCB).
5. Total IDD = IDDQ + IADD = FCK * CPD * VDDQ, for Cpd = (IDDQ + IADD) / (FCK * VDDQ) where FCK is the input frequency, VDDQ is the power supply, and CPD is the Power Dissipation Capacitance.
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