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參數資料
| 型號： | ISP1561 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | ISP1561BM |
| 中文描述： | ISP1561BM |
| 文件頁數： | 45/102頁 |
| 文件大?。?/td> | 2875K |
| 代理商： | ISP1561 |
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Philips Semiconductors
ISP1561
USB PCI host controller
Product data
Rev. 01 — 06 February 2003
45 of 102
9397 750 10015
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
11.1.6
HcInterruptDisable register (address: value read from func0 or func1 of
address 10H
+
14H)
Each disable bit in the HcInterruptDisable register corresponds to an associated
interrupt bit in the HcInterruptStatus register. The HcInterruptDisable register is
coupled with the HcInterruptEnable register. Therefore, writing logic 1 to a bit in this
register clears the corresponding bit in the HcInterruptEnable register, whereas
writing logic 0 to a bit in this register leaves the corresponding bit in the
HcInterruptEnable register unchanged. On a read, the current value of the
HcInterruptEnable register is returned. The register contains four bytes, and the bit
allocation is given in
Table 52
.
Bit
Symbol
Reset
Access
7
6
5
4
3
2
1
0
reserved
0
-
RHSC
0
R/W
FNO
0
R/W
UE
0
R/W
RD
0
R/W
SF
0
R/W
WDH
0
R/W
SO
0
R/W
Table 51:
Bit
31
HcInterruptEnable register: bit description
Symbol
Description
MIE
MasterInterruptEnable
: Logic 0 is ignored by the Host Controller.
Logic 1 enables interrupt generation by events specified in other
bits of this register.
OC
0 —
ignore
30
1 —
enable interrupt generation due to Ownership Change
reserved
0 —
ignore
29 to 7
6
-
RHSC
1 —
enable interrupt generation due to Root Hub Status Change
0 —
ignore
5
FNO
1 —
enable interrupt generation due to Frame Number Overflow
0 —
ignore
4
UE
1 —
enable interrupt generation due to Unrecoverable Error
0 —
ignore
3
RD
1 —
enable interrupt generation due to Resume Detect
0 —
ignore
2
SF
1 —
enable interrupt generation due to Start-of-Frame
0 —
ignore
1
WDH
1 —
enable interrupt generation due to HcDoneHead Writeback
0 —
ignore
0
SO
1 —
enable interrupt generation due to Scheduling Overrun
Table 52:
Bit
Symbol
Reset
Access
HcInterruptDisable register: bit allocation
31
30
MIE
OC
0
0
R/W
R/W
29
28
27
26
25
24
reserved
0
-
0
-
0
-
0
-
0
-
0
-
相關PDF資料 |
PDF描述 |
|---|---|
| ISP1561BM | ISP1561BM |
| ISP1562 | Hi-Speed Universal Serial Bus PCI Host Controller |
| ISP1562BE | Hi-Speed Universal Serial Bus PCI Host Controller |
| ISP1581 | Universal Serial Bus 2.0 high-speed interface device |
| ISP1581BD | Universal Serial Bus 2.0 high-speed interface device |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| ISP1561BM | 制造商:NXP Semiconductors 功能描述: |
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| ISP1561BM,557 | 功能描述:USB 接口集成電路 DO NOT USE ORDER -S OR -T PART RoHS:否 制造商:Cypress Semiconductor 產品:USB 2.0 數據速率: 接口類型:SPI 工作電源電壓:3.15 V to 3.45 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:WLCSP-20 |
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