參數(shù)資料
型號： ISP1562BE
廠商： NXP SEMICONDUCTORS
元件分類： 總線控制器
英文描述： Hi-Speed Universal Serial Bus PCI Host Controller
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PQFP100
封裝： 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-407-1, LQFP-100
文件頁數(shù)： 45/98頁
文件大?。?/td> 442K
代理商： ISP1562BE
9397 750 14223
Koninklijke Philips Electronics N.V. 2005. All rights reserved.
Product data sheet
Rev. 01 — 14 July 2005
45 of 98
Philips Semiconductors
ISP1562
USB PCI Host Controller
11.1.9
HcControlHeadED register
The HcControlHeadED register contains the physical address of the first ED of the control
list. The bit allocation is given in
Table 58
.
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
23
22
21
20
19
18
17
16
PCED[19:12]
0
R
12
PCED[11:4]
0
R
4
0
R
15
0
R
14
0
R
13
0
R
11
0
R
10
0
R
9
0
R
8
0
R
7
0
R
6
0
R
5
0
R
3
0
R
2
0
R
1
0
R
0
PCED[3:0]
reserved
0
R
0
R
0
R
0
R
0
R
0
R
0
R
0
R
Table 57:
HcPeriodCurrentED - Host Controller Period Current Endpoint Descriptor register
bit description
Address: Value read from func0 or func1 of address 10h + 1Ch
Bit
Symbol
Description
31 to 4
PCED[27:0]
PeriodCurrentED
: This is used by the Host Controller to point to the
head of one of the periodic lists that must be processed in the current
frame. The content of this register is updated by the Host Controller
after a periodic ED is processed. The HCD may read the content in
determining which ED is being processed at the time of reading.
3 to 0
reserved
-
Table 58:
Address: Value read from func0 or func1 of address 10h + 20h
Bit
31
Symbol
Reset
0
Access
R
Bit
23
Symbol
Reset
0
Access
R
Bit
15
Symbol
Reset
0
Access
R
Bit
7
Symbol
Reset
0
Access
R
HcControlHeadED - Host Controller Control Head Endpoint Descriptor register bit allocation
30
29
28
27
26
25
24
CHED[27:20]
0
R
20
CHED[19:12]
0
R
12
CHED[11:4]
0
R
4
0
R
22
0
R
21
0
R
19
0
R
18
0
R
17
0
R
16
0
R
14
0
R
13
0
R
11
0
R
10
0
R
9
0
R
8
0
R
6
0
R
5
0
R
3
0
R
2
0
R
1
0
R
0
CHED[3:0]
reserved
0
R
0
R
0
R
0
R
0
R
0
R
0
R
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