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參數資料
| 型號： | ISP1761BE,518 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP128 |
| 封裝： | 14 X 20 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT425-1, LQFP-128 |
| 文件頁數： | 103/164頁 |
| 文件大?。?/td> | 767K |
| 代理商： | ISP1761BE,518 |
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ISP1761_5
NXP B.V. 2008. All rights reserved.
Product data sheet
Rev. 05 — 13 March 2008
42 of 163
NXP Semiconductors
ISP1761
Hi-Speed USB OTG controller
When a bit in the PTD Skip map is set to logic 1 that PTD will be skipped although its V bit
may be set. The information in that PTD is not processed. For example, NextPTDPointer
will not affect the order of processing of PTDs. The Skip bit should not normally be set on
the position indicated by NextPTDPointer.
8.2.12 INT PTD Last PTD register
The bit description of the register is given in Table 30.
Once the LastPTD bit corresponding to a PTD is set, this will be the last PTD processed
(checking V = 1) in that PTD category. Subsequently, the process will restart with the rst
PTD of that group. This is useful to reduce the time in which all the PTDs, the respective
memory space, would be checked, especially if only a few PTDs are dened. The
LastPTD bit must normally be set to a higher position than any other position indicated by
the NextPTDPointer from an active PTD.
8.2.13 ATL PTD Done Map register
Table 31 shows the bit description of the ATL PTD Done Map register.
This register represents a direct map of the done status of the 32 PTDs. The bit
corresponding to a certain PTD will be set to logic 1 as soon as that PTD execution is
completed. Reading the Done Map register will clear all the bits that are set to logic 1, and
the next reading will reect the updated status of new executed PTDs.
8.2.14 ATL PTD Skip Map register
The bit description of the register is given in Table 32.
Table 29.
INT PTD Skip Map register (address 0144h) bit description
Bit
Symbol
Access
Value
Description
31 to 0
INT_PTD_SKIP_
MAP[31:0]
R/W
FFFF FFFFh
INT PTD Skip Map: Skip map for each of the 32 PTDs for the INT
transfer
Table 30.
INT PTD Last PTD register (address 0148h) bit description
Bit
Symbol
Access
Value
Description
31 to 0
INT_PTD_LAST_
PTD[31:0]
R/W
0000 0000h INT PTD Last PTD: Last PTD of the 32 PTDs.
1h — One PTD in INT
2h — Two PTDs in INT
3h — Three PTDs in INT
Table 31.
ATL PTD Done Map register (address 0150h) bit description
Bit
Symbol
Access
Value
Description
31 to 0 ATL_PTD_DONE_
MAP[31:0]
R
0000 0000h
ATL PTD Done Map: Done map for each of the 32 PTDs for the ATL
transfer
Table 32.
ATL PTD Skip Map register (address 0154h) bit description
Bit
Symbol
Access
Value
Description
31 to 0
ATL_PTD_SKIP_
MAP[31:0]
R/W
FFFF FFFFh
ATL PTD Skip Map: Skip map for each of the 32 PTDs for the ATL
transfer
相關PDF資料 |
PDF描述 |
|---|---|
| ITR8307 | SPECIALTY OPTOELECTRONIC DEVICE |
| IXF1010 | 10 CHANNEL(S), 1000M bps, LOCAL AREA NETWORK CONTROLLER, CBGA552 |
| JANTX1N3595US-1 | 0.15 A, SILICON, SIGNAL DIODE |
| JAN1N3595US-1 | 0.15 A, SILICON, SIGNAL DIODE |
| JANTXV1N3595US-1 | 0.15 A, SILICON, SIGNAL DIODE |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| ISP1761BEUM | 功能描述:IC USB OTG CONTROLLER HS 128LQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 控制器 系列:- 標準包裝:4,900 系列:- 控制器類型:USB 2.0 控制器 接口:串行 電源電壓:3 V ~ 3.6 V 電流 - 電源:135mA 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:36-VFQFN 裸露焊盤 供應商設備封裝:36-QFN（6x6） 包裝:* 其它名稱:Q6396337A |
| ISP1761ET | 功能描述:USB 接口集成電路 USB 2.0 HS OTG HOST RoHS:否 制造商:Cypress Semiconductor 產品:USB 2.0 數據速率: 接口類型:SPI 工作電源電壓:3.15 V to 3.45 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:WLCSP-20 |
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