參數(shù)資料
型號： M30833FJFP
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 30 MHz, MICROCONTROLLER, PQFP100
封裝： PLASTIC, QFP-100
文件頁數(shù)： 79/159頁
文件大?。?/td> 3896K
代理商： M30833FJFP
Under
development
Preliminary Specifications REV.1.02
Specifications in this manual are tentative and subject to change.
Mitsubishi Microcomputers
M32C/83 group
SINGLE-CHIP 16/32-BIT CMOS MICROCOMPUTER
Reset
25
Status
CNVSS = VCC
CNVSS = VSS
BYTE = VSS
BYTE = VCC
Pin name
P0
P1
P2, P3, P4
P50
P51
P52
P53
P54
P55
P56
P57
Input port (high-impedance)
Data input (high-impedance)
Address output (indeterminate)
BCLK output
RAS output
WR output (output "H")
RD output (output "H")
RDY input (high-impedance)
Input port (high-impedance)
BHE output (indeterminate)
HLDA output (output value depends on an input to HOLD pin)
HOLD input (high-impedance)
Input port (high-impedance)
Notes :
1. Ports P11 to P15 are provided in the 144-pin package.
P6 to P15 1
b15
b0
b23
0016
000016
b31
000016
00000016
Contents of addresses
FFFFFE16 to FFFFFC16
Data register (R2/R0H/R0L)
Address register (A0)
Static base register (SB)
Frame base register (FB)
User stack pointer (USP)
Interrupt stack pointer (ISP)
Interrupt table register (INTB)
Program counter (PC)
General register
b15
b0
000016
Flag register (FLG)
IPL
U I O B S Z D C
b7
b8
? 0 0 0 ? ? ? ? 0 0 0 0 0 0 0 0
b0
0016
Data register (R2)
Data register (R3)
Address register (A1)
Data register (R3/R1H/R1L)
High-speed interrupt register
b15
b0
b23
?
DMAC-associated register
b7
b0
b23
0016
b15
Save Flag register (SVF)
Save PC register (SVP)
Vector register (VCT)
DMA mode register (DMD0)
DMA transfer count register (DCT0)
DMA transfer count reload register (DRC0)
DMA memory address register (DMA0)
DMA SFR address register (DSA0)
DMA memory address reload register (DRA0)
DMA mode register (DMD1)
DMA transfer count register (DCT1)
DMA transfer count reload register (DRC1)
DMA memory address register (DMA1)
DMA SFR address register (DSA1)
DMA memory address reload register (DRA1)
0016
?
0 : "0" after reset
? : Indeterminate after reset
Table 1.4.1. Pin Status
Internal Space
Figure 1.4.3 shows CPU register states after reset. Refer to the section "SFR" about a SFR state after
reset.
Figure 1.4.3. CPU Register after Reset
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PDF描述
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