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參數(shù)資料
| 型號： | M48Z2M1YPL |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | 122 x 32 pixel format, Compact LCD size |
| 中文描述： | 16兆的2Mb × 8 ZEROPOWER的SRAM |
| 文件頁數(shù)： | 6/12頁 |
| 文件大?。?/td> | 102K |
| 代理商： | M48Z2M1YPL |
Symbol
Parameter
M48Z2M1 / M48Z2M1Y
Unit
-70
Min
Max
t
AVAV
Read Cycle Time
70
ns
t
AVQV (1)
Address Valid to Output Valid
70
ns
t
ELQV
(1)
Chip Enable Low to Output Valid
70
ns
t
GLQV (1)
Output Enable Low to Output Valid
35
ns
t
ELQX
(2)
Chip Enable Low to Output Transition
5
ns
t
GLQX
(2)
Output Enable Low to Output Transition
5
ns
t
EHQZ
(2)
Chip Enable High to Output Hi-Z
30
ns
t
GHQZ
(2)
Output Enable High to Output Hi-Z
25
ns
t
AXQX
(1)
Address Transition to Output Transition
5
ns
Notes:
1. C
L
= 100pF (see Figure 4).
2. C
L
= 5pF (see Figure 4)
Table 9. Read Mode AC Characteristics
(T
A
= 0 to 70
°
C; V
CC
= 4.75V to 5.5V or 4.5V to 5.5V)
AI02051
tAXQX
DATA VALID
A0-A20
DQ0-DQ7
tAVAV
tAVQV
Figure 6. Address Controlled, Read Mode AC Waveforms
Note:
Chip Enable (E) and Output Enable (G) = Low, Write Enable (W) = High.
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M48Z2M1, M48Z2M1Y
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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