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參數(shù)資料
| 型號： | MACH210A-12VC |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | High-Density EE CMOS Programmable Logic |
| 中文描述： | EE PLD, 12 ns, PQFP44 |
| 封裝： | TQFP-44 |
| 文件頁數(shù)： | 22/47頁 |
| 文件大小： | 347K |
| 代理商： | MACH210A-12VC |
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29
MACH210AQ-15/20 (Com’l)
CAPACITANCE (Note 1)
Parameter
Symbol
Parameter Description
Test Conditions
Typ
Unit
CIN
Input Capacitance
VIN = 2.0 V
VCC = 5.0 V, TA = 25
°C,
6
pF
COUT
Output Capacitance
VOUT = 2.0 V
f = 1 MHz
8
pF
SWITCHING CHARACTERISTICS over COMMERCIAL operating ranges (Note 2)
Parameter
Symbol
Parameter Description
Min
Max
Min
Max
Unit
tPD
Input, I/O, or Feedback to Combinatorial Output
(Note 3)
15
20
ns
D-type
13
17
ns
T-type
14
18
ns
tH
Register Data Hold Time
0
ns
tCO
Clock to Output (Note 3)
7
8
ns
tWL
Clock
LOW
6
8
ns
tWH
Width
HIGH
6
8
ns
D-type
50
40
MHz
T-type
47.6
38.4
MHz
fMAX
D-type
58.8
45.4
MHz
T-type
55.5
43.4
MHz
D-type
76.9
58.8
MHz
T-type
71.4
55.5
MHz
tSL
Setup Time from Input, I/O, or Feedback to Gate
13
17
ns
tHL
Latch Data Hold Time
0
ns
tGO
Gate to Output (Note 3)
8
ns
tGWL
Gate Width LOW
6
8
ns
tPDL
Input, I/O, or Feedback to Output Through
Transparent Input or Output Latch
17
22
ns
tSIR
Input Register Setup Time
2
ns
tHIR
Input Register Hold Time
2.5
3
ns
tICO
Input Register Clock to Combinatorial Output
18
23
ns
tICS
Input Register Clock to Output Register Setup
17
22
ns
18
23
ns
tWICL
Input Register
LOW
6
8
ns
tWICH
Clock Width
HIGH
6
8
ns
fMAXIR
Maximum Input Register Frequency
1/(tWICL + tWICH)
83.3
62.5
MHz
tSIL
Input Latch Setup Time
2
ns
tHIL
Input Latch Hold Time
2.5
3
ns
tIGO
Input Latch Gate to Combinatorial Output
20
25
ns
tIGOL
Input Latch Gate to Output Through Transparent
Output Latch
22
27
ns
tSLL
Setup Time from Input, I/O, or Feedback Through
Transparent Input Latch to Output Latch Gate
15
19
ns
tIGS
Input Latch Gate to Output Latch Setup
18
23
ns
Maximum
Frequency
(Note 1)
Setup Time from Input, I/O,
or Feedback to Clock
External Feedback
1/(tS + tCO)
Internal Feedback (fCNT)
No Feedback
1/(tS + tH)
-15
-20
D-type
T-type
tS
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MACH210A-7 | High-Density EE CMOS Programmable Logic |
| MACH215-12JC | High-Density EE CMOS Programmable Logic |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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