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參數(shù)資料
| 型號： | MC13214 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, BGA71 |
| 封裝： | 9 X 9 MM, 1 MM HEIGHT, ROHS COMPLIANT, LGA-71 |
| 文件頁數(shù)： | 69/366頁 |
| 文件大?。?/td> | 3955K |
| 代理商： | MC13214 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁當(dāng)前第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁第305頁第306頁第307頁第308頁第309頁第310頁第311頁第312頁第313頁第314頁第315頁第316頁第317頁第318頁第319頁第320頁第321頁第322頁第323頁第324頁第325頁第326頁第327頁第328頁第329頁第330頁第331頁第332頁第333頁第334頁第335頁第336頁第337頁第338頁第339頁第340頁第341頁第342頁第343頁第344頁第345頁第346頁第347頁第348頁第349頁第350頁第351頁第352頁第353頁第354頁第355頁第356頁第357頁第358頁第359頁第360頁第361頁第362頁第363頁第364頁第365頁第366頁
Modem Interrupt Description
MC1321x Reference Manual, Rev. 1.1
8-4
Freescale Semiconductor
subsequent active operation will abort immediately. This condition occurs because the LO1 unlock causes
an operation abort and the status bit must be cleared or any follow-on operation will also abort.
The best practice is to enable the pll_lock_irq interrupt so that IRQ will be asserted if an unlock occurs.
If the pll_lock_irq interrupt is not enabled and an LO1 unlock occurs, no rx_rcvd_irq status will be
set for an RX operation nor will a cca_irq status be set for a CCA operation because the operation
was aborted. As a result, an interrupt cannot be generated, and any follow-on operation will be
aborted.
If the pll_lock_irq interrupt is not enabled for a TX operation and an unlock occurs, the tx_sent_irq
status will be set when the TX aborts, so an interrupt can be generated. However, any follow-on
operation will still be aborted if the IRQ_Status Register is not read.
8.3
Attn_irq Status Bit and Interrupt Operation
As described in Section 5.28, “IRQ_Status - Register 24”, attn_irq status bit indicates:
The transceiver has achieved Idle status (full power-up) after the release of the RST signal. The
default condition out of reset leaves the attn_irq interrupt request enabled, and upon the transceiver
reaching Idle, the attn_irq status is set and the IRQ signal is asserted
Signal ATTN has been asserted (normally to release the transceiver from Hibernate or Doze mode)
and the transceiver has exited the low power mode. The IRQ signal will be asserted if the interrupt
has not been masked
8.4
Interrupts from Exiting Low Power Modes
The modem has three low power modes and interrupt generation differs somewhat for each mode.
8.4.1
Exiting Off Mode (Reset)
The transceiver is put in reset and stays in reset (Off Mode) through the assertion of RST. The initialization
done at reset enables attn_mask which allows an interrupt request when attn_irq is set. One condition that
sets attn_irq is when the transceiver exits reset after RST is released high. As a result, an interrupt request
will always be generated by attn_irq status when reset is exited.
8.4.2
Exiting Hibernate Mode
Hibernate is normally only exited through assertion of ATTN (obviously RST can still override). The
attn_irq status will be set by the assertion of ATTN. If an interrupt is desired to signify the event, the
attn_mask bit must be set before entering Hibernate. The interrupt request will then be generated due to
the attn_irq being set true upon exit from Hibernate.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC14000UBCPD | 4000/14000/40000 SERIES, DUAL 3-INPUT NOR GATE, PDIP14 |
| MC14174BCPD | 4000/14000/40000 SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDIP16 |
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| MC145011DW | SPECIALTY ANALOG CIRCUIT, PDSO16 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC13214R2 | 制造商:Freescale Semiconductor 功能描述:IC TXRX RF 2.4GHZ Z-STACK 71-LGA |
| MC1321X | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述: |
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| MC13224V | 制造商:Freescale Semiconductor 功能描述:; Controller Family/Series:(ARM7); Memor |
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