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參數(shù)資料
| 型號： | MC13214 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, BGA71 |
| 封裝： | 9 X 9 MM, 1 MM HEIGHT, ROHS COMPLIANT, LGA-71 |
| 文件頁數(shù)： | 82/366頁 |
| 文件大小： | 3955K |
| 代理商： | MC13214 |
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MCU Modes of Operation
MC1321x Reference Manual, Rev. 1.1
10-4
Freescale Semiconductor
10.6.2
Stop2 Mode
The Stop2 Mode provides very low standby power consumption and maintains the contents of RAM and
the current state of all of the I/O pins. Stop2 can be entered only if the LVD circuit is not enabled in stop
modes (either LVDE or LVDSE not set).
Before entering Stop2 Mode, the user must save the contents of the I/O port registers, as well as any other
memory-mapped registers they want to restore after exit of Stop2, to locations in RAM. Upon exit of
Stop2, these values can be restored by user software before pin latches are opened.
When the MCU is in Stop2 Mode, all internal circuits that are powered from the voltage regulator are
turned off, except for the RAM. The voltage regulator is in a low-power standby state, as is the ATD. Upon
entry into Stop2, the states of the I/O pins are latched. The states are held while in Stop2 Mode and after
exiting Stop2 mode until a 1 is written to PPDACK in SPMSC2.
Exit from Stop2 is performed by asserting either of the wake-up pins: RESET or IRQ, or by an RTI
interrupt. IRQ is always an active low input when the MCU is in Stop2, regardless of how it was
configured before entering Stop2.
Upon wake-up from Stop2 Mode, the MCU will start up as from a power-on reset (POR) except pin states
remain latched. The CPU will take the reset vector. The system and all peripherals will be in their default
reset states and must be initialized.
After waking up from Stop2, the PPDF bit in SPMSC2 is set. This flag may be used to direct user code to
go to a Stop2 recovery routine. PPDF remains set and the I/O pin states remain latched until a 1 is written
to PPDACK in SPMSC2.
To maintain I/O state for pins that were configured as general-purpose I/O, the user must restore the
contents of the I/O port registers, which have been saved in RAM, to the port registers before writing to
the PPDACK bit. If the port registers are not restored from RAM before writing to PPDACK, then the
register bits will assume their reset states when the I/O pin latches are opened and the I/O pins will switch
to their reset states.
For pins that were configured as peripheral I/O, the user must reconfigure the peripheral module that
interfaces to the pin before writing to the PPDACK bit. If the peripheral module is not enabled before
writing to PPDACK, the pins will be controlled by their associated port control registers when the I/O
latches are opened.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC14000UBCPD | 4000/14000/40000 SERIES, DUAL 3-INPUT NOR GATE, PDIP14 |
| MC14174BCPD | 4000/14000/40000 SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDIP16 |
| MC14174BD | 4000/14000/40000 SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO16 |
| MC145011DW | SPECIALTY ANALOG CIRCUIT, PDSO16 |
| MC2850-13-1 | 0.1 A, 2 ELEMENT, SILICON, SIGNAL DIODE |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC13214R2 | 制造商:Freescale Semiconductor 功能描述:IC TXRX RF 2.4GHZ Z-STACK 71-LGA |
| MC1321X | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述: |
| MC1321X_09 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ZigBee?- Compliant Platform - 2.4 GHz Low Power Transceiver for the IEEE? 802.15.4 Standard plus Microcontroller |
| MC13224V | 功能描述:射頻收發(fā)器 PIP 802.15.4 2.4G IND RoHS:否 制造商:Atmel 頻率范圍:2322 MHz to 2527 MHz 最大數(shù)據(jù)速率:2000 Kbps 調(diào)制格式:OQPSK 輸出功率:4 dBm 類型: 工作電源電壓:1.8 V to 3.6 V 最大工作溫度:+ 85 C 接口類型:SPI 封裝 / 箱體:QFN-32 封裝:Tray |
| MC13224V | 制造商:Freescale Semiconductor 功能描述:; Controller Family/Series:(ARM7); Memor |
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