參數(shù)資料
型號： MC56F8345VFGE
廠商： Freescale Semiconductor
文件頁數(shù)： 117/172頁
文件大?。?/td> 0K
描述： IC DSP 16BIT 60MHZ 128-LQFP
標(biāo)準(zhǔn)包裝： 72
系列： 56F8xxx
核心處理器： 56800E
芯體尺寸： 16-位
速度： 60MHz
連通性： CAN，EBI/EMI，SCI，SPI
外圍設(shè)備： POR，PWM，溫度傳感器，WDT
輸入/輸出數(shù)： 49
程序存儲器容量： 136KB（68K x 16）
程序存儲器類型： 閃存
RAM 容量： 6K x 16
電壓 - 電源 (Vcc/Vdd)： 2.25 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 16x12b
振蕩器型： 外部
工作溫度： -40°C ~ 105°C
封裝/外殼： 128-LQFP
包裝： 托盤
配用： MC56F8367EVME-ND - EVAL BOARD FOR MC56F83X
Peripheral Memory Mapped Registers
56F8345 Technical Data, Rev. 17
Freescale Semiconductor
49
Preliminary
Table 4-10 External Memory Integration Registers Address Map
(EMI_BASE = $00 F020)
Register
Acronym
Address
Offset
Register Description
Reset Values
CSBAR 0
$0
Chip Select Base Address Register 0
0 x 0004 = 64K since
EXTBOOT = EMI_MODE
= 0
This
tab
le
added
to
p
rovide
complete
information,
but
this
peripheral
is
not
functional
in
the
56F8345/56F8145
pack
age
CSBAR 1
$1
Chip Select Base Address Register 1
0 x 0004 = 64K since
EMI_MODE = 0
CSBAR 2
$2
Chip Select Base Address Register 2
CSBAR 3
$3
Chip Select Base Address Register 3
CSBAR 4
$4
Chip Select Base Address Register 4
CSBAR 5
$5
Chip Select Base Address Register 5
CSBAR 6
$6
Chip Select Base Address Register 6
CSBAR 7
$7
Chip Select Base Address Register 7
CSOR 0
$8
Chip Select Option Register 0
CSOR 1
$9
Chip Select Option Register 1
CSOR 2
$A
Chip Select Option Register 2
CSOR 3
$B
Chip Select Option Register 3
CSOR 4
$C
Chip Select Option Register 4
CSOR 5
$D
Chip Select Option Register 5
CSOR 6
$E
Chip Select Option Register 6
CSOR 7
$F
Chip Select Option Register 7
CSTC 0
$10
Chip Select Timing Control Register 0
CSTC 1
$11
Chip Select Timing Control Register 1
CSTC 2
$12
Chip Select Timing Control Register 2
CSTC 3
$13
Chip Select Timing Control Register 3
CSTC 4
$14
Chip Select Timing Control Register 4
CSTC 5
$15
Chip Select Timing Control Register 5
CSTC 6
$16
Chip Select Timing Control Register 6
CSTC 7
$17
Chip Select Timing Control Register 7
BCR
$18
Bus Control Register
Table 4-11 Quad Timer A Registers Address Map
(TMRA_BASE = $00 F040)
Register Acronym
Address Offset
Register Description
TMRA0_CMP1
$0
Compare Register 1
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