參數(shù)資料
型號: MC56F8345VFGE
廠商: Freescale Semiconductor
文件頁數(shù): 51/172頁
文件大小: 0K
描述: IC DSP 16BIT 60MHZ 128-LQFP
標(biāo)準(zhǔn)包裝: 72
系列: 56F8xxx
核心處理器: 56800E
芯體尺寸: 16-位
速度: 60MHz
連通性: CAN,EBI/EMI,SCI,SPI
外圍設(shè)備: POR,PWM,溫度傳感器,WDT
輸入/輸出數(shù): 49
程序存儲器容量: 136KB(68K x 16)
程序存儲器類型: 閃存
RAM 容量: 6K x 16
電壓 - 電源 (Vcc/Vdd): 2.25 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 16x12b
振蕩器型: 外部
工作溫度: -40°C ~ 105°C
封裝/外殼: 128-LQFP
包裝: 托盤
配用: MC56F8367EVME-ND - EVAL BOARD FOR MC56F83X
56F8345 Technical Data, Rev. 17
144
Freescale Semiconductor
Preliminary
Figure 10-8 Recovery from Stop State Using Asynchronous Interrupt Timing
10.9 Serial Peripheral Interface (SPI) Timing
Table 10-17 SPI Timing1
Characteristic
Symbol
Min
Max
Unit
See Figure
Cycle time
Master
Slave
tC
50
ns
Enable lead time
Master
Slave
tELD
25
ns
Enable lag time
Master
Slave
tELG
100
ns
Clock (SCK) high time
Master
Slave
tCH
17.6
25
ns
Clock (SCK) low time
Master
Slave
tCL
24.1
25
ns
Data set up time required for inputs
Master
Slave
tDS
20
0
ns
Data hold time required for inputs
Master
Slave
tDH
0
2
ns
Access time (time to data active from
high-impedance state)
Slave
tA
4.8
15
ns
Disable time (hold time to high-impedance state)
Slave
tD
3.7
15.2
ns
Data Valid for outputs
Master
Slave (after enable edge)
tDV
4.5
20.4
ns
Not IRQA Interrupt Vector
tIW
IRQA
tIF
A0–A15
First Instruction Fetch
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